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allegro铜皮导致的短路

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发表于 2015-10-26 13:10 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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客户反馈板有个地方作短路了。一看原来是铜皮没有被genesis正确导入导致短路,可惜只有gerber,没有pcb,不知道pcb是如何铺的铜皮导致这个问题的产生。
+ Z( H' Z* y: p! D- r( ^有没有谁碰到过?allegro比较少出现这个问题,好像update drc会检查铜皮错误。+ `7 `3 H1 V. M- A9 N' l- v0 s
; b; N( P/ r. @7 R
* o% {( u! e/ n1 V$ @, p9 f: Y. E1 i
正确的文件应该如下:5 q4 |7 r: L  t5 ^$ B
) L; x* ~8 S1 {. R7 m
, ~, H* c, Y5 e+ y7 S& x

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 楼主| 发表于 2015-11-24 16:10 | 只看该作者
ann_wz 发表于 2015-11-7 08:40
- j  Z) v8 U- ]- @8 O+ V* I! r5 Ipads画的板子还是有可能的,allegro应该不太可能
6 Q& G$ y3 [& H
百分百allegro 因为光绘文件的后缀是.art 4 |1 l  U" Q. @4 ^5 z

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发表于 2015-11-24 15:26 | 只看该作者
什么软件都有可能,只是DRC没做好

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发表于 2015-11-7 08:40 | 只看该作者
pads画的板子还是有可能的,allegro应该不太可能

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百分百allegro 因为光绘文件的后缀是.art  详情 回复 发表于 2015-11-24 16:10

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发表于 2015-11-6 20:06 | 只看该作者
我觉得update drc是一个, 还有好像没有update to smooth,update to smooth后应该不会这样子

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 楼主| 发表于 2015-10-31 08:39 | 只看该作者
65770096 发表于 2015-10-30 15:07
# M! |: y! e' L- g6 p, W# z感觉是规则设置的问题,感觉像测试点什么的,shape to test point?

4 f* H0 u. N, X. C3 P不是测试点
& v) L5 W% O$ m# |" F

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发表于 2015-10-30 15:07 | 只看该作者
感觉是规则设置的问题,感觉像测试点什么的,shape to test point?

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不是测试点  详情 回复 发表于 2015-10-31 08:39

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 楼主| 发表于 2015-10-29 17:54 | 只看该作者
今天又一个这样的问题板  大家一定update drc呀
' h( n. n; w8 ?5 n" Z
4 `* p  `. s; l  U
+ y* r2 H& Z5 E7 R
) ?  f: F0 L, ^* t. m$ f* T

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 楼主| 发表于 2015-10-26 17:44 | 只看该作者
5718366 发表于 2015-10-26 17:33
; j6 E; C: V3 k1 p- O8 a用allegro5年,还真没出现过这种问题,正如你所说,铺好铜后,要是有短路或间距小于设计规则会报错。
' k% w9 C5 v9 [这个 ...

4 ~0 V2 S7 I8 |不是线宽变化引起的 是铜皮引起的 因为调入光绘时提示有自交叉铜皮 线宽不会引起这个问题
: `( {- E5 Y8 p7 t- @3 n1 P) U

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发表于 2015-10-26 17:33 | 只看该作者
用allegro5年,还真没出现过这种问题,正如你所说,铺好铜后,要是有短路或间距小于设计规则会报错。: I: o5 r2 j$ f- t" T" t% r
这个可能是因为走线的时候变换了宽度,造成的一个尖角短路

点评

不是线宽变化引起的 是铜皮引起的 因为调入光绘时提示有自交叉铜皮 线宽不会引起这个问题  详情 回复 发表于 2015-10-26 17:44
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