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求《IC封装基础与工程设计实例》第4章的每一小节的工程保存文件

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发表于 2015-5-28 21:32 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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请问能提供《IC封装基础与工程设计实例》第4章的每一小节的工程保存文件吗?我照着书本,还是完成不了。
2 I3 F8 T3 b- g; Z; _  }比如:6 g* z) M" ?8 t: s$ V

& X( D) z9 j8 n4 Y' E( I# I2 N

0 D3 u) Q1 ^0 B4.12节怎么摆放都有DRC;9 u% O# d9 c8 A! }- u: G+ x- x& O' H
4.15调整不好交叉鼠线;
& ]( u* ~9 a2 F% [....
6 Z% |( }  m: [( L" h6 l' S' c(可能我太笨了)4 \# P: p% _& j  }& ]1 ~
. R+ e* q+ p: r) ?; G8 t
! c9 A' }) E& p6 d/ J9 t
无法进行下一步,特请高人发布一下文件,谢谢!/ C& [' T8 l+ J! M4 l5 A
1 A+ a7 Q  M, u$ [9 ^
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发表于 2016-12-24 10:14 | 只看该作者
每一小节的工程保存文件

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发表于 2016-5-9 23:44 | 只看该作者
同求

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发表于 2015-7-22 16:55 | 只看该作者
jason1937 发表于 2015-5-29 10:33: |5 d2 j7 |! g! j5 ]1 X
4.12节的VSS的Bond Wire 有必要连接到die flag的Bond Guide Line上吗?4.13节的图4-56怎么没显示?

! u+ L/ T- F" q) h8 c3 |% ~9 m4 K可以不用放置在die flag, 有位置就可以咯。
$ `  s6 ~$ w; \

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发表于 2015-7-22 16:53 | 只看该作者
DRC可能使DIE pin之间的间距小于你的约束值, 交叉鼠线存在不代表就不好呀,鼠线是直线路径显示,不要太在意。

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 楼主| 发表于 2015-5-29 10:33 | 只看该作者
4.12节的VSS的Bond Wire 有必要连接到die flag的Bond Guide Line上吗?4.13节的图4-56怎么没显示?

点评

可以不用放置在die flag, 有位置就可以咯。  详情 回复 发表于 2015-7-22 16:55
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