EDA365电子工程师网
标题:
如何确定信号线需要做等长处理以及其长度的公差?
[打印本页]
作者:
天天在线
时间:
2015-3-19 08:42
标题:
如何确定信号线需要做等长处理以及其长度的公差?
在PCB设计中,经常遇到要做等长处理,对于常见电路如DDR3等就直接进行了等长处理,可有时候遇到的网络不常见,不知道需不需要做等长,如果需要又是如何来确定这个等长误差,这个问题一直困扰着我,有没有大师能给解释一下?
2 N- t/ W+ y3 K) H3 q4 o
作者:
cousins
时间:
2015-3-19 10:09
如果我说仿真可以决定你要不要等长你一定不信。
4 g1 ~6 {2 ~2 r& q& a
8 n; r$ p0 `6 R9 F9 z4 h& t
等长的目的主要是为了满足时序。调整线宽的目的主要是为了高低电平寄存有效的time以及可靠的单调性。
6 e; {7 I0 l$ |/ L
所以准确的模型可以用来确定你是否一定要做等长。
- _: L/ z1 h6 ]4 I
至少我所了解的很多项目中,等长的DDR性能未必是最好的。一定是有某些走线长一些,有些走线短一点可以满足最佳的时序或者最佳的眼图。
作者:
红孩儿
时间:
2015-3-19 10:16
我相信cousins。
欢迎光临 EDA365电子工程师网 (https://bbs.elecnest.cn/)
Powered by Discuz! X3.2