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[Hspice仿真] Hspice中有个地方请高手帮忙解答

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发表于 2015-3-17 11:48 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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在做DDR仿真时 用到一个LFSR关键词,其中有个参数tap——the bits used to generate feedback,在例子中用到方式为[2,5],请高手帮忙解释下此[2,5]的意思,这个地方小弟没有理解

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发表于 2015-12-3 17:51 | 只看该作者
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发表于 2015-9-17 08:55 | 只看该作者
7七楼讲解的相当详细:victory:

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发表于 2015-5-1 15:07 | 只看该作者
Head4psi 发表于 2015-3-18 10:45
1 n1 H+ L! C! l# W! `8 hTabs = [ 5, 2 ]* d3 z( R, V  B  X) J6 w' o
Total 5 stages shift register as tab1,tab2,tab3,tab4,tab5 sequence, tab 5 is output ...
# t2 S4 O8 W8 R- `* O( B3 z3 ^$ B
能翻译的通俗易懂点吗?
! S- w9 V5 T8 R. I8 z英文看着有点费解啊!!!( A0 K6 f1 E- g1 v' p  ?
TKS!
, b( }% N" [) m/ G, L9 @

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发表于 2015-5-1 14:52 | 只看该作者
7七楼讲解的相当详细,受教了!!

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 楼主| 发表于 2015-3-18 22:15 | 只看该作者
谢谢各位  已经解释很详细了

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发表于 2015-3-18 15:54 | 只看该作者
本帖最后由 shark4685 于 2015-3-18 15:56 编辑 , s4 s7 _" N" G" X( E' V7 G) h
) f( J9 K% F4 V0 o+ p& Q0 P
LFSR (Linear Feedback Shift Register) 线性反馈移位寄存器,通常是数字信号的伪随机码(PRBS)的一种码形发生器,
可以理解为一种加密形式。,来产生PRBS7-----PRBS127不同长度的数字信号码形。
LFSR的原理就是把输出的代码与输入的代码进行异或后再输出.

( ]' G. b/ `. o( R/ D
/ b8 D/ O$ k- B
如你跑的这个例子:
8 O6 A1 g; v  W6 h# a  o
vin out gnd LFSR (0 1 0 1n 1n 10meg 3 [2, 5] rout=10)
  u# {6 `6 B6 \  ^0 e$ a! \! N& Q" C: g6 u. _! _: u/ U; k, I2 O
.option POST
$ y8 D% G+ \  Q) W& Q: `
$ P! x- l# N9 }+ y.tran 10p 10u .end , B: X3 G  [; t2 s8 g0 l, V2 T

/ q# i0 r1 W) \5 u- K信号低压为 0, 高压为1,延时为 0ms,上升下降时间各为1ns,速率10Mbps,种子(seed)为3(00011)5 L/ M0 H8 l2 t) M) c% e- `

$ o, l3 K9 V8 K( C! Q[2, 5]表示输出的第二个和第五个码型与输入的做XOR(异或)后再次输出,Rout=10欧
( p1 o0 W# X! p. q! f% C; k6 b3 ]1 c& ~4 i+ `  B, F
---------------------------------------希望可以帮到你在hspice一路上走的更远。
/ V7 F' Y1 m. |0 H8 D3 e
- N/ v  |: s* v7 E9 c2 Y  s, ~: ~! [( M+ w( H

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发表于 2015-3-18 10:45 | 只看该作者
Tabs = [ 5, 2 ]
  V0 c/ |6 R8 o% @Total 5 stages shift register as tab1,tab2,tab3,tab4,tab5 sequence, tab 5 is output.
2 u+ r: g/ S$ Z3 N( X3 SXOR the outputs of stage 2 and 5 (tab 5, 2)  as the input of shift register.9 Q) H1 n, I+ V
For exmaple, if seed =1+ s$ b8 w, J* ^
The initial Q state of register are 00001, the next input bit for register 1 is XOR tab2 and tab5, it should be 1.
" w& [7 Q; q6 E* h: zThe second Q state of register are 10000, the next input bit for register 1 is XOR tab2 and tab5, it should be 0....... and so on.
: k7 f+ w- D( qThe random output bit string will be: 1000010101110..... , repeat after 32 bits.
; F7 A6 A, M' z: Z  O+ X) q" r" BDifferent seed and tabs will give different bit sequence.# K$ ^+ }6 b6 f& q2 k7 v
" \% s+ h4 w6 K& D! R9 Z

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能翻译的通俗易懂点吗? 英文看着有点费解啊!!! TKS!  详情 回复 发表于 2015-5-1 15:07

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 楼主| 发表于 2015-3-18 10:12 | 只看该作者
工程没有问题 参照厂家和例子设置可以跑通  目前我想知道这里这样设置的意义
: M6 [6 A2 w+ C6 K工程发不出来 公司不允许外发资料  见谅

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发表于 2015-3-18 09:05 | 只看该作者
如果方便,把工程发给我,我帮你看看

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发表于 2015-3-17 17:09 | 只看该作者
这个问题能回答你的人还真不多,先记在我这里,今天没空,包帮你解决。

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 楼主| 发表于 2015-3-17 13:39 | 只看该作者
求高手解答
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