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allegro设置room问题,求助。

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发表于 2015-3-3 16:38 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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x
1.已在edit-properties中将元器件设置room属性,* u1 x5 }, h+ A" I, R
2.然后setup-outlines-room outline画好room区域,
, N5 x: K& Q1 s3 f, v; Q3.place-quickplace中选上place by room却没有任何room?! H3 ]8 V4 \* @6 s' s8 Z
请教这是什么问题?我哪一步做错了,谢谢。
9 P# w8 t$ _$ x; J- ?
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发表于 2015-3-4 13:23 | 只看该作者
lms 发表于 2015-3-4 11:399 I  P" x: t, C. ~) ?, i) G3 e
我正是按这个方法设置的,可是不成功,不知为什么?请看我发的问题,请教你一下我那里出错了?
( O6 D! q/ v4 G! D3 W) C9 f
设置完以后,要把零件删掉哦。
# Z! v3 D: W7 M, @. q
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发表于 2015-3-4 13:22 | 只看该作者
lms 发表于 2015-3-4 10:35
* {5 {6 a1 ^1 }) [7 \4 j2 ~9 T3 s7 F6 M这个第一方格式是什么意思,如何设置,多谢解答

( N$ t4 C1 S9 `- k7 K& U" k/ _第一方网表格式就是在OrCAD输出网表时,选择PCB Editor选项卡导出网表,如图1,Allegro导入网表时选择Cadence标签页,不要选Other方式,如图2。
6 G7 h* N2 {$ m# q) }; }8 h4 \9 f- w  Q
$ Y. `6 I) ]! l
图1+ _/ f) f8 s5 B9 s1 N, j
" U4 c  m. g4 `

" L: a& p+ R* T5 {5 U2 e3 W7 \  @) _: i3 `* e& t
图2
1 S  N* ?4 S9 f) [9 D& w, L4 |
$ F/ X3 U) |$ j' ?第一方网表对原理图的规范性要求比较高,例如原理图元件的所有管脚都要有Pin Name、Pin Number、不能有非电源属性的相同Pin Name(图3)、原理图元件管脚数与PCB封装管脚数一一对应等要求。0 I3 H+ F' A2 D
# _2 d! J  K6 J# S& {% j
图3
8 M4 I2 u5 \$ ?& U
7 u3 C- j3 N: k) ~# ]" M
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 楼主| 发表于 2015-3-4 11:39 来自手机 | 只看该作者
dzkcool 发表于 2015-3-4 10:35
- F6 w  e  W; W1 TPCB中也能设置,要把零件先从后台放出来,用Edit-> Properties,Find面板中只勾选Comps,单击所需设置的 ...

7 K! I" P1 X% ^! \7 r( s3 m2 K! b5 d我正是按这个方法设置的,可是不成功,不知为什么?请看我发的问题,请教你一下我那里出错了?

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设置完以后,要把零件删掉哦。  详情 回复 发表于 2015-3-4 13:23

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 楼主| 发表于 2015-3-4 10:35 来自手机 | 只看该作者
dzkcool 发表于 2015-3-4 09:57
3 x( R* {: G% c+ Z7 _4 x9 n! U导出网表要用第一方格式,导出时Allegro.cfg文件中应当有ROOM=YES的设置。

0 `! x* Q% B& }这个第一方格式是什么意思,如何设置,多谢解答

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第一方网表格式就是在OrCAD输出网表时,选择PCB Editor选项卡导出网表,如图1,Allegro导入网表时选择Cadence标签页,不要选Other方式,如图2。 [attachimg]93576[/attachimg] 图1 [attachimg]93577[/attachi  详情 回复 发表于 2015-3-4 13:22

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发表于 2015-3-4 10:35 | 只看该作者
lms 发表于 2015-3-4 10:24
7 D* `/ T: U7 v" S1 C# H这个room属性只能从原理图中带过来?直接在pcb中设置不行吗?
; R( M! V! c$ L) w
PCB中也能设置,要把零件先从后台放出来,用Edit-> Properties,Find面板中只勾选Comps,单击所需设置的零件,选择Room属性,设置对应数值。5 J5 G/ d$ f. Q/ s% n+ C

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我正是按这个方法设置的,可是不成功,不知为什么?请看我发的问题,请教你一下我那里出错了?  详情 回复 发表于 2015-3-4 11:39
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 楼主| 发表于 2015-3-4 10:24 来自手机 | 只看该作者
dzkcool 发表于 2015-3-4 09:57
* [. W2 Z8 P2 P9 ?$ e导出网表要用第一方格式,导出时Allegro.cfg文件中应当有ROOM=YES的设置。
1 D! ]6 k1 n' R6 h
这个room属性只能从原理图中带过来?直接在pcb中设置不行吗?

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PCB中也能设置,要把零件先从后台放出来,用Edit-> Properties,Find面板中只勾选Comps,单击所需设置的零件,选择Room属性,设置对应数值。  详情 回复 发表于 2015-3-4 10:35

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发表于 2015-3-4 09:57 | 只看该作者
导出网表要用第一方格式,导出时Allegro.cfg文件中应当有ROOM=YES的设置。

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这个第一方格式是什么意思,如何设置,多谢解答  详情 回复 发表于 2015-3-4 10:35
lms
这个room属性只能从原理图中带过来?直接在pcb中设置不行吗?  详情 回复 发表于 2015-3-4 10:24

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 楼主| 发表于 2015-3-4 09:40 来自手机 | 只看该作者
wwddss_1976 发表于 2015-3-3 21:009 f3 b. R1 \6 e+ D/ m  t& r
room属性要从原理图带入PCB中才行

1 S; m5 Q# }; P% J2 S9 r( m- S不是有两种方法吗?一种是你说的从原理图带入,另一种是直接在PCB里设置,我想学会的是后一种方法,谢谢

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发表于 2015-3-3 21:00 | 只看该作者
room属性要从原理图带入PCB中才行

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lms
不是有两种方法吗?一种是你说的从原理图带入,另一种是直接在PCB里设置,我想学会的是后一种方法,谢谢  详情 回复 发表于 2015-3-4 09:40
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