|
EDA365欢迎您!
您需要 登录 才可以下载或查看,没有帐号?注册
x
问题:, v2 i. d8 \5 k, e. i. d/ C
% f; N2 \' u2 b0 e9 N6 v1\stitching设置是缝合孔,到底有什么实际性的作用,跟不勾选有什么区别呢+ ^3 y; g3 d% j6 k
1 v, c/ L5 }, O/ `# @- r2 G4 K) Q& L7 T- R' S
( }! s1 j( y& ^/ _5 d5 g
2 o+ R+ U+ [$ H8 M$ W; F) C. F$ k N4 k# F" |0 O+ W9 l; a. I# r! i2\ 为了使连通性检查不出错,一个个把它们改过来真是麻烦,有什么好的方法? " T4 ?7 j% d7 h6 j ^7 K0 n
, N( t d) n3 \! Y4 W7 B9 y0 B# W, }. J; v: u
+ u$ \$ ~9 M+ g5 Y& X5 w $ C/ q; ]+ S' m7 [" m
- h: f6 a) h# V# ]: v8 T3\我在filte过虑器里面只选VIA却选不上它们,难道它们不是过孔了吗?7 |1 t! L4 m# n# h) Y% G: v1 [1 ~+ r" \& h9 Q3 g6 n
$ ]/ D8 G7 F2 |& V: t
5 t: I. S* w3 y ! P& B; y1 O W% I/ {, h. x v. q7 I" _" v0 w9 e d7 U* H
4\从2007到2005这些孔怎么就加上勾了呢,其他的信号线过孔怎么没有报连通性错误呢?" k+ [) U8 ]' C) l
6 C. H' ?6 \& t# q' L3 a; X( o+ X& @- S' g9 F( E1 H
4 }( U4 B# {" f1 s
- t, ~' O) q9 ~# c7 q0 \5 \5 M, R4 @5\怎么避免这种情况呢,以前怎么没有碰到..1 d! }! l0 f/ _- B( ]
$ w4 I: h0 d. d5 z& T3 n
. P" e$ e+ s/ \8 k; I+ S5 t( p! @( A$ }( U0 S0 m" z' _6\有没有关于这stitching的资料,让我也见识一下..谢谢了/... |
|