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FPGA JTAG调试正常,烧写后功能失败

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发表于 2013-9-13 17:50 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
现象:6 w; f4 S3 g* K& O; X7 [
1.在JTAG调试模式,FPGA配置正常,通过SignalTap查看逻辑功能正常(输出端口)。
$ e8 i; Z$ j2 p  r$ i8 G! r6 w2.配置芯片(EPCS4)可成功烧写,配置模式AS模式。- V5 a9 F6 ~% M( m& H0 {% n5 Z9 ^
3.烧写后重启单板,FPGA功能无输出。  j; f! r2 E$ x5 k7 N- G  h, Q. C

5 n2 P0 U; x2 V解决:5 q+ n$ y: K/ ~! G3 |0 j
1.FPGA引脚补焊后,烧写后FPGA功能正常。2 T  s+ _1 r  h9 H

* s: [: }2 k" P5 z不知道那些引脚会导致上述所描述的现象???2 D7 @% u' N8 \( ^/ ~+ Q" r
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发表于 2013-9-15 06:41 | 只看该作者
msel0-1-2,dclk,asdo等都有可能

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 楼主| 发表于 2013-9-15 21:41 | 只看该作者
guowei680 发表于 2013-9-15 06:41! R2 I6 T2 E  K1 J
msel0-1-2,dclk,asdo等都有可能
8 Y3 i0 R- x6 K/ G% V- ]/ X
这些引脚应该会 影响烧写吧!

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发表于 2013-9-16 08:19 | 只看该作者
你的AS口,其实可以拿掉的。可以用JTAG转烧的,文件类型转下jic那个的,JTAG间接配置
硬件工程师[原理图+PCB],电驱动方面,无刷控制器,电动工具,太阳能无刷泵,锂电保护板,仅限Altium。

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 楼主| 发表于 2013-9-16 12:39 | 只看该作者
zgq800712 发表于 2013-9-16 08:19$ }* a* A2 G7 L3 ]6 k
你的AS口,其实可以拿掉的。可以用JTAG转烧的,文件类型转下jic那个的,JTAG间接配置
1 i9 S5 w; F, h* [. v! u1 J
配置文件用的就是.jic文件。
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