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好奇怪的shape避让问题,请大家帮看看

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发表于 2013-7-29 18:27 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
10E币
约束管理器设置了shape到shape的距离是0,但是铜皮之间会避让,避让的间距是5mil,不知道这个5mil是哪里来的,下面发图:$ \# @, f, Q, {( [

& b% `+ }  T) {% h9 e. ~" d/ V% iVDD_5V铺铜和GND 铺铜避让- a6 c: h9 l- e* Y- K# l; {

! U) I* T5 [) g) y: n; D$ ] : F9 m  H0 n# M7 N! p' @1 H
设定的shape和shape的间距是05 p  {% c. N8 o+ e2 A( j- O0 U4 N
2 P7 h8 }* z2 e- i3 U
4 P! r2 y4 B' X! ?5 F/ e$ e* O
shape参数
- V) X& i3 K! _1 a* r
) K, k" m* p# a3 w8 R
  r8 l6 j) X$ B3 R+ t约束规则报告

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发表于 2013-7-29 18:32 | 只看该作者
为啥要设置为0?

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发表于 2013-7-29 20:38 | 只看该作者
我用16.3试了下,是可以实现的。楼主需要说明自己所使用的版本。
+ m9 W3 K, R0 U9 @2 A7 W; F) ^而且,楼主的第一个图的信息不完整,没有包括DGND的shape间距设置。

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 楼主| 发表于 2013-7-30 08:23 | 只看该作者
软件版本是16.3 。我在人家板子的基础上修改的,改好之后板子已经发出去了发现了这个问题,这个地方是避让了,但是万一其他地方没有避让,又不报drc错误就惨了,如下是gnd shape的规则:  F% l8 j% F! v9 |' U

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 楼主| 发表于 2013-7-30 08:28 | 只看该作者
李明宗伟 发表于 2013-7-29 20:38 ( u  B4 U4 W6 p9 c/ v- J& `  Z
我用16.3试了下,是可以实现的。楼主需要说明自己所使用的版本。
( U% f& h1 B( m$ A6 k& G" }# r而且,楼主的第一个图的信息不完整,没有 ...
6 W0 V" }& A3 l- V$ ~: T6 k' i$ N- r
是可以避让还是不能避让,避让的间距是多少,有没有drc错误报告,我的是16.6版本,GND的shape约束见上图

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发表于 2013-7-30 17:51 | 只看该作者
这里有没有设置

QQ图片20130730175111.jpg (75.42 KB, 下载次数: 0)

QQ图片20130730175111.jpg

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发表于 2013-7-30 21:23 | 只看该作者
httpftpli 发表于 2013-7-30 08:28
* S9 B7 ]- K3 p是可以避让还是不能避让,避让的间距是多少,有没有drc错误报告,我的是16.6版本,GND的shape约束见上图

/ Z" E% k, B& p" U: r4 H可以不避让的。3 T( s+ I4 Z5 `* X5 |9 \8 Y

( ?/ G* s! ?: C至于你的文件避让的具体原因,没有工程文件我断定不了。。。

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 楼主| 发表于 2013-7-31 12:04 | 只看该作者
Able 发表于 2013-7-30 17:51 8 [* a$ ~- J5 b; ~$ T0 N5 ^
这里有没有设置

! A7 ^% m! X+ P4 ^5 n9 z1 j; Y5 l0 Q1 u没有设置,已经上传了工程文件

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 楼主| 发表于 2013-7-31 12:08 | 只看该作者
李明宗伟 发表于 2013-7-30 21:23 / S: c/ ]) b5 T9 T5 W" F% d
可以不避让的。  V& G  k; U; }: j9 G* `# e

+ P5 p) ~8 t8 P" V7 K9 G8 d9 d至于你的文件避让的具体原因,没有工程文件我断定不了。。。

3 p, O& d3 B; O: }: ^+ H. s4 N上工程文件  ) ~" l8 O2 }' @# K6 e
7 @( p7 e9 E6 |7 @- y0 U
BONE_PCB(1).zip (1.71 MB, 下载次数: 30)

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发表于 2013-7-31 13:39 | 只看该作者
httpftpli 发表于 2013-7-31 12:08 , [. v7 _  {$ p/ b% s/ ~
上工程文件

6 Z; X: ]2 v3 |4 [; ?3 k确定文件没穿错?

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发表于 2013-7-31 13:55 | 只看该作者
因为你的VDD_5V Shape 已经定义成网络了,

QQ图片20130731135303.jpg (55.08 KB, 下载次数: 0)

QQ图片20130731135303.jpg

QQ图片20130731135351.jpg (87.71 KB, 下载次数: 0)

QQ图片20130731135351.jpg

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发表于 2013-7-31 14:09 | 只看该作者
静态铜和动态铜的属性不一样

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发表于 2013-7-31 21:29 | 只看该作者
本帖最后由 李明宗伟 于 2013-7-31 21:30 编辑
# j" M6 i5 F6 ?5 x4 t; j2 l1 C
* C0 S/ Z# z5 p6 ~楼上那位说了一大堆原因,有自己动手试试么?! m: _& |* e' c8 S  C
用16.3打开工程文件后,没有做任何设定改动,直接给DGND铺了一片动态铜,结果与VDD_5V的铜皮是直接接起来的,没有出现有5mil间距的现象。所以楼主的问题无法重现。: k  J9 E2 Q; P0 P5 {  a
4 D3 X* j% J- @- U

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 楼主| 发表于 2013-7-31 21:30 | 只看该作者
Scott.Dong 发表于 2013-7-31 13:39 8 i: x3 g$ {$ y5 t
确定文件没穿错?

' J- s: ?" I( y" \这个文件不是我发帖截图的那个文件,但是一样存在这个问题的,我后来试了一下于博士视频教程中的工程文件,把shape的间距修改成0 ,也是避让的,避让的间距也是5mil,我怀疑可能是软件的限制了,我用的allegro 16.6   11号补丁。

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 楼主| 发表于 2013-7-31 21:31 | 只看该作者
Able 发表于 2013-7-31 13:55 / x, d2 E: e1 `- M% D; F  s$ ?
因为你的VDD_5V Shape 已经定义成网络了,
  k' M! @1 r8 }" k
shape是有网络的,你第一个图是physical constrain,和间距应该没关系
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