四个DDR3放在同一面的等长请教

与你同行 · 发表于 2013-7-11 16:31

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请问各位老大，如图附件中4个DDR3放在同一面时等长关系是怎样的？有知道的请详细告知。谢谢！

与你同行 · 发表于 2013-7-17 10:52

大师上面图片已标示出来了。请问四个DDR在同一面，图中B5C5 B5D5和C5F5 D5E5是什么关系。

suicide915 · 发表于 2013-10-15 10:49

part99 发表于 2013-7-23 21:586 s# w' `/ C; R. T
你layout的顺序有问题，应该先布控制命令线，然后布每组11根的数据线，最后走时钟。
0 }5 p7 S, p- ^# f) Y2 V/ n控制命令线和时钟都从 ...

请问 fly-by这种拓扑结构的等长

DDR3片片之间的地址线怎样等长

jimmy · 发表于 2015-4-14 09:28

书上18章不是有详细介绍和视频演示吗？

《PADS9.5实战攻略与高速PCB设计》

与你同行 · 发表于 2013-7-12 09:51

怎么没人回复啊！

Aubrey · 发表于 2013-7-12 10:04

采用fly-by拓扑结构（最好按datasheet的建议），地址\控制与时钟做等长，误差不超过25mil；数据线组内等长，误差不超过10mil。

hnhjw · 发表于 2013-7-12 10:12

论坛里有搜索等长

jimmy · 发表于 2013-7-12 11:19

你要将数据线，地址控制线的飞线高亮指示出来。

chengzi_lxc · 发表于 2013-7-12 15:36

与你同行发表于 2013-7-12 09:51
: G. D4 X- V+ [9 P8 r8 X/ y怎么没人回复啊！

给个demo参考下~~

与你同行 · 发表于 2013-7-12 15:46

大师：四个DDR3在同一面时，请帮我标明图中各点等长的关系，谢谢！

与你同行 · 发表于 2013-7-12 16:14

请以这副图为准。

huqiming588 · 发表于 2013-7-15 18:37

chengzi_lxc 发表于 2013-7-12 15:36 : T4 \: K8 J w8 H. P/ u3 v i
给个demo参考下~~

谢谢分享！

xiaoyangren · 发表于 2013-7-15 22:03

chengzi_lxc 发表于 2013-7-12 15:36
* X: x& [* `1 h: I给个demo参考下~~

学习了，谢谢分享。

zzlhappy · 发表于 2013-7-16 09:04

是什么版本呀，
太高了，打不开呀？

lgswp · 发表于 2013-7-16 09:23

谢谢分享，还是得慢慢来啊

leemy · 发表于 2013-7-16 09:44

谢谢分享

jacobf · 发表于 2013-7-16 10:56

谢谢

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