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pads中关于ECO TO PCB 的问题 急死我了!!

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发表于 2008-10-24 09:20 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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最近一直在画FPGA部分,发现了很多操作上的问题。
! T6 n. b# }8 d# C( L+ J$ D在原理图中,FPGA的PART TYPE是由多个DCEAL组成的,在PCB布线过程中难免会在不同的管脚间进行网络的交换,当把所有要连到FPGA的线整齐地放到它周围,就等着调整FPGA管脚后,才发现,原来FPGA管脚网络改变后,从LOGIC ECO 到 LAYOUT后所有原来放置好的线全部被删除,也就是说,凡是调整过的网络的连线都被删除了,这样会给布线带来很大的麻烦,不知道大家是怎么样做的?, y. w; {4 K; N) L: B7 Q; K$ v
谢谢大家回答咯
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发表于 2008-10-24 09:55 | 只看该作者
可以ECO PCB TO LOGIC3 S3 x1 k6 j: r' P
這樣可能要好點
凡是有膽量來到這個世上的人都知道,誰也別想活著離開這個世界

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发表于 2012-12-18 12:06 | 只看该作者
以后要慢慢抛弃pads了,太不好用了。问题还很多,ECO模式删个器件,GND的孔全掉了;平时删个孔如果其他的地孔不保护,如果没有线连接的话也TM全掉了,什么破软件。

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发表于 2012-12-18 13:09 | 只看该作者
将FPGA周围连好的线做成reuse。然后再进行eco to pcb.
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发表于 2012-12-18 13:10 | 只看该作者
kdc252626658 发表于 2012-12-18 12:06 7 }% x- o6 D& |" A
以后要慢慢抛弃pads了,太不好用了。问题还很多,ECO模式删个器件,GND的孔全掉了;平时删个孔如果其他的地 ...

" @- `  z2 k5 r& G5 {+ X* z; N删除器件时,此项不要选
* c. \% p+ Z  s: v1 P7 T) d8 h" T- E, Q# c
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发表于 2012-12-18 13:11 | 只看该作者
删除器件前,也可将整板的过孔进行glued和stitching
) ]# h5 C( \! |6 W0 z) Y% q2 K4 L. [. ~7 ~" \. O' t% t3 R
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发表于 2012-12-18 13:14 | 只看该作者
问题:删个孔如果其他的地孔不保护,如果没有线连接的话也全掉了) g9 Y4 e& ?4 {6 C1 l% p
) w/ v0 f. t2 h4 a( ]
答:只要你的过孔不是直接复制,而是通过select nets,选中某个器件的GND网络的管脚后来add via的,都不会掉。每个软件都有自己的特点,如果要用它,就只有去熟悉它的脾性才能更好的驾驭它。要不然,建议你换其他软件。
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发表于 2012-12-18 13:54 | 只看该作者
JIMMY,霸气!

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发表于 2013-2-17 15:59 | 只看该作者
jimmy 发表于 2012-12-18 13:14 % G- g. @4 {2 l9 G( L' x8 k
问题:删个孔如果其他的地孔不保护,如果没有线连接的话也全掉了
4 o. G$ r# n& l: R+ D- M' X' \& C5 A$ L- g) W
答:只要你的过孔不是直接复制,而是通 ...
  }9 u4 [4 `! E4 @; d
多谢指教,是自己太浮躁了。

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发表于 2013-2-17 16:01 | 只看该作者
jimmy 发表于 2012-12-18 13:10
* c2 d5 V! X$ K删除器件时,此项不要选

0 z( e3 k/ j+ O6 ~$ B1 k上边这个 delete routes 勾勾,我都勾掉的,但删除器件,相连的网络还是经常回掉,掉的非常干净,只能重新走一遍。哎,是我的器件有问题?

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发表于 2013-2-17 17:05 | 只看该作者
kdc252626658 发表于 2013-2-17 16:01 $ ~+ j/ {. k6 ]/ v
上边这个 delete routes 勾勾,我都勾掉的,但删除器件,相连的网络还是经常回掉,掉的非常干净,只能重新 ...

5 f9 C; l9 Z1 Y3 ^( w, K  y可以将相关的PCB和最新原理图发给我试试看。
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发表于 2013-2-17 19:58 | 只看该作者
jimmy可以说是这方面的权威了啊
0 o) x- X2 Q4 Q4 N$ `

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发表于 2013-3-4 18:06 | 只看该作者
jimmy 发表于 2013-2-17 17:05
# _' D3 n* a# q' y可以将相关的PCB和最新原理图发给我试试看。

' Y  s; ]- `$ K0 m4 w6 K" n' y2 v, C! ~% R) z! F' Y
1 j7 B7 o- I" [8 l5 w
jimmy,你好!
$ B% w/ j- C/ c" O5 i* w+ C: T( V. B) R: i
    您能帮我检查问题真是十分荣幸!pcb是pads2007画的,原理图是用orcad画的。把原理图映射到pcb是用到导出网表的方法。$ Y3 }' J, P/ U, v- j4 H/ L  d8 s
原理图几经易手,画的比较凌乱,器件命名也很不规范,勿见笑。6 ~0 i2 D. i- V; Q! j" V2 o
: f+ L4 i2 p- S2 P5 T8 x" ^9 K
举例:拿删除连接器U6来说,在eco模式下删除,即便勾掉delete routes,软件同样会提示与之相连的网络会删除(点到点的会删除,有分支的则不会)。' D: o1 c' [- P$ c
    多谢释疑!
) c6 z8 U3 @- f: w. Z& \4 {1 @/ E+ A  j% ?0 [8 T" r2 I# e
8 |! v) g7 l5 r# [7 b  Q5 w
还有另外一个问题,如果我的板子原本6层,后改版降为4层,不知有没有简便的方法操作。我之前的做法是把要减掉的两层的所以信息全部删除,包括贯穿的VIA才能降层成功,否则总是提示要删除的层上还有东西。因为动作实在过大,之后我就不减层了,只是是布线的时候空出某两层,一根线都不走,一片铜都没有,出gerber的时候只出有效的层的信息给板厂,这样也可以解决问题。但总有一丝遗憾。出的gerber中,过孔的信息显示的还是6层,总是要给板厂解释。不知道是否有其他简便的方法?还请多多指教!谢谢!

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发表于 2013-3-4 18:07 | 只看该作者
jimmy 发表于 2013-2-17 17:05 / B0 a8 e/ y1 j8 m
可以将相关的PCB和最新原理图发给我试试看。

: r! u8 I9 U! n5 B# k5 q+ B1 C3 ]5 x RC01_V1.0-PCB&SCH.rar (198.28 KB, 下载次数: 34) ; l' Y3 P5 Y* |- I. K
& ^- N& a$ [: f$ @! @) r
附件丢了,补上。

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发表于 2013-3-4 18:07 | 只看该作者
zhangjinhe 发表于 2013-2-17 19:58 - Q* U' W. N1 z- f" M9 A
jimmy可以说是这方面的权威了啊

- U% p: {2 J3 X3 _" I8 \那是,膜拜!
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