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ORCAD 封装引脚对齐

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哈达恋

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发表于 2015-10-29 21:03 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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使用cadence三个月了，还没体会到比altium designer好在哪里，画的基本都是两层板，没有用到什么特殊工具，觉得cadence把简单的事情复杂化了，很浪费时间，AD半小时可以完成的事情，cadence差不多要1-2小时。。。
7 Z' A& J$ n3 E" O2 L  T  D: }* P不由得开篇感慨了一下。。。。
$ d2 z1 z; }# L! |, U% T    * k0 A- D- O2 R8 T0 z; m( c
   如上图，我画了个原理图元件封装，已经网格对齐了，也对属性进行了一些设置$ }/ O4 a3 _+ x9 {( j: I; [( y

4 p' t% r) H. |% J; y' [    但是到了原理图绘制界面时，就是不对齐，它就是不对齐！！！，还变了模样！！~！！你说这是闹哪样？？？？？？？
" J* v5 j2 K. d5 {/ H/ A. i; C) D
8 }' X* Q% ]1 ?- ^) O/ i+ z    朋友们，你们提醒我下怎么解决吧。。。我没招了。感谢~5 {" i9 O* h# j; C) D# N  f
4 G* V% X$ e* O0 i" s
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哈达恋

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 楼主| 发表于 2015-10-29 21:20 | 只看该作者
坑死了，我画完保存，重新打开还是原来的模样。。。

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12345liyunyun

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发表于 2015-10-30 00:00 | 只看该作者
外面那虚线框没对齐

点评

哈达恋
这个有可能，我后来关闭重启电脑就好了。。。  详情 回复 发表于 2015-12-19 21:03

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哈达恋

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 楼主| 发表于 2015-12-19 21:03 | 只看该作者
12345liyunyun 发表于 2015-10-30 00:00
- k- R+ m- a* T# b5 K* @: w外面那虚线框没对齐

* F7 N3 Z) Q- S' a3 Y" D8 Z这个有可能，我后来关闭重启电脑就好了。。。0 b2 [/ b+ N9 Z3 n2 L. s+ {

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