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EDA365电子工程师网»技术社区 › 电子技术社区 › Cadence Sigrity仿真论坛 › cadence16.6的创建和16.3的不一样？
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cadence16.6的创建和16.3的不一样？

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mokedeng

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发表于 2014-6-4 11:03 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
在cadence16.3中创建总线执行菜单命令Logic---Indentify Buses可以直接创建总线，然后在约束管理器中可以直接看到定义的总线。3 Z0 g6 }) \  g5 q1 \- x/ D

7 @6 L2 a* x2 P$ a" v5 U) a& x6 y/ b& k5 P, L, S6 Y2 Q
但是在cadence16.6中，首先创建总线 如图所示! m$ @* z4 F+ ?( F* D
* S# `9 E+ D  w9 i- l- w
* n$ q% ^' \- g8 N/ H
. F, Q3 O) P1 {  _3 h
点击确定之后 是一个signal bus setup的对话框
8 a0 l5 [; d6 e9 k9 r6 N. K' l# O . _7 h4 o: d' U6 g+ r; q! D2 N- }
2 g( ]$ I! w1 t, ]. k: \; U, `
0 \& e$ |* T3 A' J' C

4 v4 b8 h$ C' Q. j在这个对话框里面应该怎么操作呢
  r, T4 A: C& k* @) ^3 V6 w1 g1 X
使得在约束管理器中出现总线的设置
  ~/ {) A# v* H  I( X6 P1 ~, }5 W* V ! V) L, d% y6 H
$ @2 J/ X0 T" c8 A
; l/ j4 s3 i4 [( B, L! v
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 楼主| 发表于 2014-6-5 23:08 | 只看该作者
都没有人说说么

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