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PADS Logic 中設計規則檢查

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发表于 2012-6-28 08:29 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

EDA365欢迎您!

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請問各位大俠:PADS Logic中可以進行設計規則檢查嗎?( N6 Z. Z! x2 ^* `3 E; u
" u$ U5 X3 R, S2 u
如可以,那怎樣檢查?
% m7 j0 c5 `9 M+ U& ]  [; t8 Q6 S8 @* G, O# o& I- |9 g: X* P+ c. D1 c
謝謝!
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发表于 2012-6-28 09:16 | 只看该作者
没有,在建库和连线时阻止了,其他错误出现在导网标时出现。

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发表于 2012-6-28 10:02 | 只看该作者
不需要的, 默认就是强制开启的, 且不可以关闭.
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