找回密码
 注册

QQ登录

只需一步,快速开始

扫一扫,访问微社区

巢课
电巢直播8月计划
查看: 1767|回复: 12
打印 上一主题 下一主题

请问有关DDR的各个线长的确定

[复制链接]

33

主题

141

帖子

5566

积分

五级会员(50)

Rank: 5

积分
5566
跳转到指定楼层
1#
发表于 2009-2-19 16:36 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

EDA365欢迎您!

您需要 登录 才可以下载或查看,没有帐号?注册

x
DDR中所有的线可分为power,data,address/command,control,clock,feedback这几种,请问
" {0 ^& g6 U4 y% `9 \1.这些线应该怎样按先后次序确定其长度,怎样计算其长度?+ T, M& @- M, J8 j9 n4 @
2.看到很多资料上说DQS与CLK要满足75%-125%write data vindow,这个应该怎样理解,对于实际的DQS线长度的确定,尤其是flight time,应该怎样来考虑,需要同时考虑DQS的set up time和hold time么?
; T4 N& S( A. o5 _3.data线与DQS线长度基准是+-25mil,这个又是怎样来的,不要考虑读与写的基准偏差么?2 K) t' }% S0 c% I% i
4.address线又是怎样来定义?* Q" H/ [. a( I5 @
感觉思绪很乱,请各位大侠帮我解惑下,谢谢,如果能附图,将不胜感激
分享到:  QQ好友和群QQ好友和群 QQ空间QQ空间 腾讯微博腾讯微博 腾讯朋友腾讯朋友 微信微信
收藏收藏1 支持!支持! 反对!反对!

33

主题

141

帖子

5566

积分

五级会员(50)

Rank: 5

积分
5566
2#
 楼主| 发表于 2009-2-20 11:12 | 只看该作者
怎么没人回答

20

主题

445

帖子

1316

积分

四级会员(40)

Rank: 4Rank: 4Rank: 4Rank: 4

积分
1316
3#
发表于 2009-2-20 12:24 | 只看该作者
1.这些线应该怎样按先后次序确定其长度,怎样计算其长度?EDA365论坛7 R1 # a( J. ~) L1 o" n- y
Li :时钟和QDS是比较关键的线,先确定他们。最好是等长在100mil或者设计经验高,可以考虑多考虑一些,为什么,去看芯片手册。
7 J7 u( J# k7 w! t1 `2.看到很多资料上说DQS与CLK要满足75%-125%write data vindow,这个应该怎样理解,对于实际的DQS线长度的确定,尤其是flight time,应该怎样来考虑,需要同时考虑DQS的set up time和hold time么?EDA365论坛+ ( C- q4 _+ ]6 u$ `$ q+ e, V5 K0 G) a
Li:就是在时序上,CK和DQS有一定的约束,以前不经常提,是因为频率比较低,如果现在上400M的话,还是要考虑一些的。& E$ k3 b6 w# r; D
3.data线与DQS线长度基准是+-25mil,这个又是怎样来的,不要考虑读与写的基准偏差么?* E( c1 g! c+ T+ A
Li: 如果你知道data线是如何采样的,你就知道为什么要这么严格要求这个参数的。  w/ Z/ `1 G8 k" h  O2 C
4.address线又是怎样来定义?
5 `6 X$ p0 \4 D- ~% h" ILi:如果你知道 address线是如何采样的,你就知道该怎么定义这个长度了。

评分

参与人数 1贡献 +10 收起 理由
forevercgh + 10 感谢释疑

查看全部评分

33

主题

141

帖子

5566

积分

五级会员(50)

Rank: 5

积分
5566
4#
 楼主| 发表于 2009-2-20 13:44 | 只看该作者
本帖最后由 hallen_jumper 于 2009-2-20 17:10 编辑 " i( ]) k+ \4 i0 a7 T  B( d. r
* T1 a. s5 W, x+ k% @9 B4 G
谢谢你的解答,如果先定clk,具体要怎么定

55

主题

951

帖子

2740

积分

EDA365特邀版主

Rank: 6Rank: 6

积分
2740
5#
发表于 2009-2-23 18:33 | 只看该作者
DQS是事实上的DQ参考CLK。
sagarmatha

33

主题

141

帖子

5566

积分

五级会员(50)

Rank: 5

积分
5566
6#
 楼主| 发表于 2009-2-24 11:35 | 只看该作者
如图,可不可以这样理解,无论读写状态,DQ只相对与DQS上下升沿采样,在读取时,DQS 与数据信号同时生成;在写入时,在DQ 的中部选取.因为读取时,至少要保证在DQ的上升沿选取,而写时,不超过DQ的setup time,因而,需保证DQS与DQ的严格等长., ~" u0 b* r. s4 y
对于DQS与CLK,在写的时候,由于driver的不同,要满足一个写窗口,那tAC的规定除了芯片所固定的值,对于DQS有没有一个飞行时间的限定,如果如楼上所说,满足CLK长于DQS100mil,那是怎样的考虑
4 v6 D" P1 j, q" F$ X' J$ m由上可看,clk是所有信号的一个基准,怎样的长度保证飞行有效,难道仅仅是所有线尽量等长,而不理睬其长度的多少

1.JPG (48.05 KB, 下载次数: 4)

1.JPG

55

主题

951

帖子

2740

积分

EDA365特邀版主

Rank: 6Rank: 6

积分
2740
7#
发表于 2009-2-24 22:38 | 只看该作者
本帖最后由 forevercgh 于 2009-2-24 22:49 编辑 : m7 j7 V/ v. U3 P7 ?/ L
5 }! Y8 z& f- e  [
坐等 liqiangln 版主释疑
sagarmatha

0

主题

14

帖子

-8986

积分

未知游客(0)

积分
-8986
8#
发表于 2009-2-25 11:33 | 只看该作者
虚心学习

4

主题

64

帖子

1079

积分

四级会员(40)

Rank: 4Rank: 4Rank: 4Rank: 4

积分
1079
9#
发表于 2011-8-29 15:15 | 只看该作者
求解释

4

主题

104

帖子

193

积分

二级会员(20)

Rank: 2Rank: 2

积分
193
10#
发表于 2011-9-1 18:13 | 只看该作者
读写时序不一样,但数据都是由DQS来触发,地址线与时钟是同向的读的时候也是驱动发地址,指令不一样,读的时候DQ,DQS与时钟都是同步的,因为数据已经是在内存里面的,读的时候就是一起送出;写的时候是数据不在内存里面所以是用边沿触发。DQS是参考CLK,所以只有起始点不一样,如果CLK与DQS差太远的话这个起始距离就会变长,那么这段时间就不能传其他数据整个时间轴空闲,而地址和指令一直在发的话就会引起误操作。

4

主题

64

帖子

1079

积分

四级会员(40)

Rank: 4Rank: 4Rank: 4Rank: 4

积分
1079
11#
发表于 2011-9-6 10:44 | 只看该作者
寻求大家解释:DATA,Address,CLK这几个的线长关系是怎么样的呢?有的说data<CLK<Address,有的又说DATA&Address<CLK,

4

主题

64

帖子

1079

积分

四级会员(40)

Rank: 4Rank: 4Rank: 4Rank: 4

积分
1079
12#
发表于 2011-9-6 11:07 | 只看该作者
如下网址:http://space.ednchina.com/upload/2010/6/2/61b951f1-949b-4e96-b2c7-cb6e2cf5528e.gif

4

主题

64

帖子

1079

积分

四级会员(40)

Rank: 4Rank: 4Rank: 4Rank: 4

积分
1079
13#
发表于 2011-9-6 11:08 | 只看该作者
Intel的要求很宽,都宽到cm级的了。 新手,请各位指导,谢谢!!!!!!
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

推荐内容上一条 /1 下一条

巢课

技术风云榜

关于我们|手机版|EDA365 ( 粤ICP备18020198号 )

GMT+8, 2024-12-24 02:09 , Processed in 0.092645 second(s), 40 queries , Gzip On.

深圳市墨知创新科技有限公司

地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

快速回复 返回顶部 返回列表