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发表于 2008-5-27 14:43 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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在小系统中
2 m; e3 e3 |6 ]! ^要求DATA中的每根信号相等
* `* t* h; y: z. B9 I: h" V( m还是要求Data=address=clock?
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发表于 2008-5-27 16:15 | 只看该作者
如果能做到的话后者更好) K9 @: m1 F  \+ E* E
毕竟数据,地址,时钟工作时是一个整体

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EDA365特邀版主

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3#
发表于 2008-5-28 10:26 | 只看该作者
按理说,如果看clock沿操作的话,clock的信号要最早到- i6 U+ y6 K8 K. |
其次是address,看到地址信号,以后再取data
& o* `( n: N) \5 d/ S, }( ^4 o% \- H+ N* l7 p
但事实非如此,因为clock,data,address的拓扑是不同的,而且data是双向的。并且在芯片封装内所采用管脚模型也不同。如果还有匹配的话,就差更多了。0 R  h4 u1 J, ]  ?- Z! z* l

0 c  N! b  s6 X所以这3组之间不是简单的a=b=c等长关系,而是等长的逻辑等式.具体的要看你的芯片layout guide或者reference board.2 W6 H1 l- _, s

5 E) M1 P! B! Q2 a% W5 C如果都没有,就要做板仿了。

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发表于 2008-5-28 10:50 | 只看该作者
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