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ddr2 125M時序問題,跪求!!

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发表于 2012-1-18 10:49 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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高手們,對於125M的ddr2clk差分對與數據線和地址線相差300mil,還能調通嗎?跪求解答!
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发表于 2012-1-18 11:35 | 只看该作者
应该没有问题

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发表于 2012-1-18 11:35 | 只看该作者
绝对可以!

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发表于 2012-1-18 11:36 | 只看该作者
应该没有问题

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发表于 2012-1-18 11:36 | 只看该作者
300mil只相差大概40-50ps而已。

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 楼主| 发表于 2012-1-18 13:19 | 只看该作者
真是太感謝啦!

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 楼主| 发表于 2012-1-18 13:21 | 只看该作者
ngclj 发表于 2012-1-18 11:35
: b& `5 @  W' b0 P" A应该没有问题
, {0 c' |& |9 W. _8 g6 u
太感謝啦

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 楼主| 发表于 2012-1-18 13:21 | 只看该作者
ngclj 发表于 2012-1-18 11:36
- P$ A7 T6 O( Y; J应该没有问题
2 k- {: C$ `6 q% K. [
太感謝啦!
9 o; T! \" i) p+ h2 q; _1 q" u6 q

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发表于 2012-1-18 16:23 | 只看该作者
关键是楼主的时钟和速率都比较低,只要整体走线比较短,这点长度差不会有任何问题的!!!

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发表于 2012-2-3 17:51 | 只看该作者
绝对可以 600mil都没有问题

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发表于 2012-2-7 11:42 | 只看该作者
还有一个问题是DDR2的颗粒要求的工作频率范围要查datasheet看清楚噢
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