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请教PADS里的keep -out layer禁止高度限制的问题

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发表于 2011-12-23 10:09 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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PCB中放置keep -out layer区域并限制元件高度,请问这个高度指什么,因为PCB中元件封装只存在长和宽,那禁布区高度限制不是一个摆设?不懂,求解答,谢谢
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发表于 2011-12-23 10:27 | 只看该作者
这个属性就是高度.
) D6 w# Z" X2 f! s; T( w- u. E. ~) g  G2 o8 O% k

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 楼主| 发表于 2011-12-23 10:36 | 只看该作者
zloveyour 发表于 2011-12-23 10:27 , F1 A, D: T; k  x0 ~
这个属性就是高度.

% i6 h# m6 Q* l" n( O谢谢,呵呵,我想一般人做封装不会管这个吧

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发表于 2011-12-23 10:39 | 只看该作者
本帖最后由 zloveyour 于 2011-12-23 10:39 编辑 0 N% b$ _2 ~! ?# W, j
tingfeng_2004 发表于 2011-12-23 10:36 3 \& s+ D1 O% _; I: ^0 i
谢谢,呵呵,我想一般人做封装不会管这个吧

" G1 Q3 W( ~3 M  O: h. C
$ D4 X% x& f. s0 @我会输入这个属性., o$ K6 C2 r! j7 @
# j0 b% E$ Z5 t0 A7 B$ k7 Z
PS: 我不是一般人.{:soso_e113:}

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 楼主| 发表于 2011-12-23 10:43 | 只看该作者
zloveyour 发表于 2011-12-23 10:39 : D$ J7 q' \! @: u! N
我会输入这个属性.5 a  y7 M3 n8 N* A

. U/ F5 O9 x( _& ?PS: 我不是一般人.

$ C5 f: o$ p6 A, u  z这个属性是在做CAE封装时加上还是在原理图或PCB封装中添加的,请指教

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发表于 2011-12-23 10:51 | 只看该作者
tingfeng_2004 发表于 2011-12-23 10:43
, ]9 f1 S) _, f" H( q* t5 ?这个属性是在做CAE封装时加上还是在原理图或PCB封装中添加的,请指教
8 f  U" E$ U" R0 Q4 g
封装里也可以加, 在 PartType 也可以加.
& u: v  F" z& k" P6 b2 [( ]( G我建议还是在 PartType 中加.

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 楼主| 发表于 2011-12-23 10:54 | 只看该作者
zloveyour 发表于 2011-12-23 10:51
& ]. W' t" }# {8 R封装里也可以加, 在 PartType 也可以加.8 M$ y$ \' O  Q1 _+ Z
我建议还是在 PartType 中加.

( F" ~) z& V# G8 Z恩,我刚试过了,在Part type中加了,谢谢

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发表于 2011-12-23 13:00 | 只看该作者
tingfeng_2004 发表于 2011-12-23 10:54 6 F3 W& ]  K1 E7 K/ _
恩,我刚试过了,在Part type中加了,谢谢
( u0 J. f* X. k. ^6 j
不客气.
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