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如何在设计中使用两种约束规则?

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发表于 2009-6-2 14:10 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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在allegro中:Setup-->Constrains的Spacing rule set里除了DEFAULT以外还可以设置自己的约束规则(比如在Spacing Rule Set中新添加一个MYRULES的规则名,然后把Shape To Via设为15 MIL),可是如何才能在具体布线的时候用到这个规则呢??8 {; b6 A* n! q6 ^6 M

' @5 t5 X. |& V  q, m7 }下图中的两片铺铜,蓝色高亮的是3.3V,黄色高亮的是1.2V,我想让3.3V的铺铜与via过孔的air gap大一点(用MYRULES约束规则)为15mils;而1.2V的铺铜与via过孔的air gap保持6mils不变(用DEFAULT约束规则);7 U6 E7 C+ z( v* M. G* Q, e* O

# m1 y* s% E5 s+ a! ^# @! e. i图是我随手画的,只为表明我的问题,我其实就是想在布线的时候 对不同的区域用不同的约束规则布线,有没有高人知道该如何实现??小弟先感谢了!!

cadence.JPG (84.28 KB, 下载次数: 1)

cadence.JPG
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 楼主| 发表于 2009-6-2 21:04 | 只看该作者
高手帮忙啊,这个问题还蛮棘手的哦

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发表于 2009-6-2 23:00 | 只看该作者
在设置中不同的区域用不同的规则就行了。

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发表于 2009-6-3 07:33 | 只看该作者
画个area区域就好了

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发表于 2009-6-3 11:56 | 只看该作者
首先设置spcacing rule set/Attach property,net你要隔离15mil的VIA,) B  E* D8 B, P* q
然后选择set value添加一个myrules,设置下列参数。
; n$ i; z6 o! e- D再选择Assignment table 指定你添加的参数 就OK了!
任何伪装也无法遮挡自身的不足;
单纯的模仿会失去自己本身的技能;
一切脱离实际的想法都是馊主意!

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 楼主| 发表于 2009-6-3 14:44 | 只看该作者
本帖最后由 dixie9568 于 2009-6-3 14:49 编辑
1 a$ }2 v; C5 Z9 B6 C
# y, N) q7 }- N感谢vencent_xiao和jack185185的解答,可是我试了一下,还是没弄好啊……
% I" b  R$ F! d' M; p* }' ]2 {* b
能不能麻烦说得再详细点?
  T6 R$ j- D3 \) t4 w. y6 D6 l7 q
vencent_xiao:你说的area是指的constrain area么??我想知道具体怎么样在不同的area使用不同的约束条件……
$ z6 ?0 Q' q* u. E6 l
9 D' ^9 ~. {. v# Y- g7 I. vjack185185:你说的“首先设置spcacing rule set/Attach property,net你要隔离15mil的VIA,EDA365”怎么弄啊?我点击了Attach property,net后还要怎么操作??“你要隔离15mil的VIA”是什么意思?怎样做??% m# c3 P, X( ~4 i; @  N- h1 J5 _
* [. Y  X; z+ n
再次有劳各位了Orz!!

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发表于 2009-6-3 18:00 | 只看该作者
本帖最后由 ymf2529 于 2009-6-4 09:01 编辑 0 ~' Z, @' B) l, e; o% @
( O$ {0 o" V9 _( ~/ G: d& L
1.         spcacing rule set>Attach property
) A9 G) v( X/ m! h% k& T' Rnet指定3.3V, 如图的VDDàSP-3V
: C% P- u; F3 x
* G; r8 }: x' g/ f. o- N/ H
- [, n1 v4 V$ Y2 M5 Z
2.         Assignment table
0 E8 W$ ]0 h; u/ \$ N& w
, a( v& j( r8 ]5 H$ \
指定SP-3V的参数为MYRULES

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发表于 2009-6-3 19:25 | 只看该作者
学习了!谢谢

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 楼主| 发表于 2009-6-3 19:33 | 只看该作者
再次感谢大家,你们的回答使我能够继续钻研allegro!!
: b7 P. d, }2 a* |3 T谢谢楼上的ymf2529,按照你的方法试了下,解决我图中Shape To Via的air gap问题是可行的
* x% e  O; b3 Q; i  z7 \% i. }
% h6 m9 e5 C9 I  Y) S2 c7 s你的解决办法用Attach property,net-->VDD是根据net标号区分的,就是不同的网络用不同的约束条件;" n) I! e- g2 M1 \  V

6 j- |, x+ ^# d4 o但是,我想要在不同的区域中用到不同的约束条件,即一个网络标号的信号线(如net为CLK的),分别在不同的区域(如在3.3V铺铜区和1.2V铺铜区)用不同的约束条件??. J/ T% ]* f4 `( U" p5 [
) ~! v/ y! R. v
对于我在一楼所贴的图具体来说:  r) i/ r* s5 W; p1 J1 k3 j* b
假如那段水红色和蓝色的走线是net标号为CLK的走线,蓝色高亮的是3.3V铺铜,黄色高亮的是1.2V铺铜,我想让3.3V的铺铜与via过孔的air gap大一点(用MYRULES约束规则)为15mils;而1.2V的铺铜与via过孔的air gap保持6mils不变(用DEFAULT约束规则);
; A* ?  v: m) [" T  U8 p* f我想控制CLK在两个不同区域里走线时的约束条件如何控制??是不是要设约束区域??不同的约束区域(area)怎么设置不同约束条件(DEFAULT和MYSULES)??还是希望有高人能说一下

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 楼主| 发表于 2009-6-3 23:49 | 只看该作者
再次拜托大家,给解答一下啊

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发表于 2009-6-4 00:10 | 只看该作者
直接设置铜皮属性。

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发表于 2009-6-4 09:21 | 只看该作者
分别将CLK3.3V1.2V各设定不同名称,如:SP-CLKSP-3.3VSP-1.2V
( z& T4 ~7 f& L3 J( t7 T: U: g$ Q$ s再将不同属性名称于Assignment table,分别指定参数2 q+ G5 m; n, X; K6 n

2 c) _4 g5 C: W# t+ e  P: e5 J" M* B4 }7 X

% H. c, X) `6 a/ t/ e # m8 r* a' ~  h0 n: H

, F& }" R! P/ p, a/ k2 g8 g
$ [% ^& S# D4 \% g" O
此是指针对各net群组间的space

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发表于 2009-6-4 09:42 | 只看该作者
1. Constraint areas>Add> 画一范围
1 _, T  V& |& {6 j8 J4 r5 ?2. Attach property, shapes…> 指到刚画好的shape
4 s  p7 h5 f+ ~/ F% M' @    Value: 输入一名称, : 3.3V
/ Y$ j+ p  U* I5 c# m( G) D1 x' C

; |( L# C( T# r: ^: H4 u" }2 F3. 再针对此area,指定参数
! g! E. y6 y% y% y) k1 w+ x

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 楼主| 发表于 2009-6-4 22:08 | 只看该作者
哈哈,明白了!!7 C/ d, x! {  G$ z- N
感谢ymf2529哦你还编辑了图片,解释的很清楚,谢谢!!

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发表于 2009-6-7 23:56 | 只看该作者
没有那么麻烦
0 w6 i* G5 P7 J  w3 T选中你要设置的shape/ G* t4 l4 G1 h6 ^
选择parameters在里面有clearance属性,修改其值就可以了
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