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Net wire has multiple net name

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发表于 2014-7-19 21:10 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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在使用AD10的时候出现以下编译错误* \& E% N) `  m9 p+ e4 ^+ D
Net wire has multiple net name(Net label SRAM_A0. Sheet Entry U_SRAM_Interface SRAM_A0(passive))
& e# w1 ~4 R0 G, IWire SRAM_A01 b! Z+ H; i, Z6 R
Net label SRAM_A01 c! C/ a& j' v% E6 E7 L
Sheet Entry U_SRAM-Interface SRAM_A0(passive)
2 ?6 [6 A0 h( [$ j* }: |0 D
5 ^7 m9 j$ D5 N7 k8 lsheet symbol的图纸
9 p: z: H2 b7 M 1 S7 R1 L# a0 J* L' ~8 M
) l8 M. w& Z  T- x# B
总的sheet的图纸/ \4 l0 J, C/ x( f
0 i/ i2 z0 {5 B% i. f1 K+ l
' L8 N, J9 ~: y3 z  ^
为什么我所有的net name都是sram_a0,他还是说我在一根线上有多个net name。而且仅仅是warm,导入到PCB还是sram_a0, 不影响PCB layout) H4 a  v' J# Q+ y% J, g, ^
很纠结,因为一编译message满是这种错误,也不知该如何解决。很烦
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 楼主| 发表于 2014-7-19 21:37 | 只看该作者
仅当我将project->project option中的Net identifier scope更改为
. C$ Z; u6 s6 T3 vGlobal (net label and port global)  N, U8 E" l) M+ \! X
编译错误会没有,但是这非我所愿,很纠结
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