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发表于 2009-2-7 16:44 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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打开菜单tools-》design rule check时发现有一个错误:
9 v- U$ |4 V; N; LProcessing Rule : Short-Circuit Constraint (Allowed=No) (All),(All)
; x8 l2 L* ]1 Y* V- D# |  ?   Violation between Pad S1-M(55.7784mm,163.7538mm)  Multi-Layer and9 g1 q" a4 D, I. W
                     Area Fill (53.4289mm,160.1343mm) (58.5089mm,167.3733mm)  Top Layer# G  q. C! }0 {$ @
Rule Violations :1 , a7 Q: N" |9 y7 }
如图:
$ _% u# r% |9 h( u
7 S: G$ C5 ^+ v3 v' ^0 C谁知道咋回事噢,那个areafill是啥阿,toplayer我知道是红色的那片,但是没看到线阿?
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发表于 2009-2-9 08:54 | 只看该作者
你顶层的填充(最大的那块红色)和焊盘M,两个不是同一网络的东西叠加在一起,就短路了!

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发表于 2009-2-9 11:12 | 只看该作者
此問題系正常的,可以不予以理會即可

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 楼主| 发表于 2009-2-10 11:21 | 只看该作者
恩,不理会,这是标准库的

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5#
发表于 2009-2-13 23:45 | 只看该作者
我觉得应该修改一下PCB元件的管脚好.不要养成不理会的坏习惯.
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