更新新的网表导入会改变PCB设置好的规则，怎么避免这尴尬的情况

whan · 发表于 2018-5-19 15:12

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有谁知道导入原理图时，PCB设置的规则会被改动，例如我设置了一对差分走线，再更新网表导入，原本设好的差分对这时又没有规则了，求救怎么避免这尴尬的情况

wwddss_1976 · 发表于 2018-5-19 21:23

把原理图中设置的规则去掉

cjz351421568 · 发表于 2018-5-20 09:51

谢谢分享

yangjinxing521 · 发表于 2018-5-21 08:55

是的，导入的时候有个选项吧。去了

EDAhfq · 发表于 2018-5-21 15:24

一般出现这个原因就是应为原理图里有规则，网标导出的时候不要勾选就可以了。（还有一种是导网表进PCB后串容前后的查分规则乱了，这种就没办法了，软件Bug.不过可以把导完网表后的版本规则删掉，导入更新网表前的规则！）

superlish · 发表于 2018-5-22 10:09

EDAhfq 发表于 2018-5-21 15:24- ~$ v8 l. ~) t4 B/ J
一般出现这个原因就是应为原理图里有规则，网标导出的时候不要勾选就可以了。（还有一种是导网表进PCB后串 ...

有串器件的设置XNET就好了

li262925 · 发表于 2018-5-22 11:52

学习

852963 · 发表于 2018-5-31 18:09

学习

moretime · 发表于 2018-6-3 13:18

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