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4片DDR3等长请教

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liuchao6102616

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发表于 2018-3-16 11:07 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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没有做过DDR3的PCB Layout 查了一些资料  请教几个问题：如图  单片分组：数据组1  数据组2   地址命令控制时钟一组  
$ Q9 q* A& f" L# V1 ^/ L! A# I% p问题1： 单片中数据组1和数据组2之间需要误差要控制多少？" W- j, f+ W0 X3 u: `8 S
问题2： 地址命令控制时钟组内等长误差控制多少？
# L0 p' d% e! I5 H, l问题3： 地址命令控制时钟组合数据组间等长误差控制多少？
& t0 e) R  P3 f$ z" q) _. I9 f8 p问题4： 每片DDR3之间是否有等长要求？
+ Q0 m1 }2 B  u望大神们指教  感谢！  
" r& U7 D7 I: z2 A" N, H" S7 g; [4 o

; s; V- V  ^7 m9 o( u3 R2 F# Y
' `- J. l% ~: R. G# I# r" o
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superlish

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版务助理

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2#
发表于 2018-3-16 17:37 | 只看该作者
分组等长即可
七尺寒光凛冽！痛饮热血四方！

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baby_snow11

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发表于 2018-5-18 22:33 | 只看该作者
学习了

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