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本帖最后由 Cadence_CPG_Mkt 于 2018-1-29 11:07 编辑 / T! D, k7 Q0 U3 M% l$ k
+ s& B3 N! c7 c' fAllegro PCB 17.2-2016发行版增强了钻孔相关功能 我们为实际的钻孔工具、背钻工具、方形孔、沉头孔等增加了焊盘定义，并增加了钻孔容差。应广大用户需求，背钻位置现在完全支持DRC间距规则。（见升级到Allegro17.2-2016的10大理由之4:行业领先的背钻能力）。) s: @6 b/ t, V2 f% i \
同时更新的还有标准钻孔间距DRC的行为变化。追溯到16.2版本，我们提供了钻孔DRC来支持 “内层无盘工艺” 功能。该检查功能只有在焊盘被删除、或者焊盘尺寸比钻孔小时（测位焊盘）才有效。从那以后，出现了针对钻孔检查的大量需求，无论焊盘是否存在。 $ s$ B. F8 p9 E5 x# \$ S, J2 F
增强的钻孔DRC 在Allegro PCB 17.2中，分析模式中添加了新的间距选项控制开关—称为“Checkholes within pads”的设计模式菜单。 打开开关，运行钻孔检查时直接使用钻孔信息（在该DRC计算模式下，与是否存在跟钻孔相连的焊盘无关）。换句话说，无论是否存在焊盘，都会进行钻孔检查。 关闭开关，钻孔检查只有当焊盘被抑制或处于未定义状态、暴露空孔时才相关。这是缺省的设置，并与之前版本兼容。8 t0 g( R, M$ |7 x
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) b8 R- u1 Z( s% _9 i, ]锐角检测 设计规则DRC也引入了基于四个角度的检查。锐角检查通过newSetup-> Constraints -> Modes command运行，然后选择Design Modes (Acute AngleDetection)进入到AnalysisModes。DRC模式可设置为On-line、Off或Batch模式，角度可在<0: 90>度范围内进行设置。 8 w: Z. }9 d" |; v" C4 K8 A
) @ V. g. ^ C E
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在Acute Angle DRC视图，DRC标记包括字符“AA”，则为报错。Acute Angle DRC Checks表现为：
2 D/ ~ u) f3 v H) s+ ^. q最小shape边缘到边缘& F0 {$ m! K# `1 z
铜层轮廓为锐角且角度过小
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焊盘入口与线段产生锐角3 O4 E; n* w# J6 `- ^* q
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/ q a- o& Y/ ]5 Q5 |! F! }最小线到角度 铜层与线段交叉产生锐角4 O$ e8 j! ?7 }. A
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. m: m8 v( j6 S- U" A1 c$ T# o最小线对角度 线段交叉产生锐角
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5 I; A8 N9 p* y- e+ H) oNet Class-Class规则分配 很多用户担心我们在约束管理器中展示Net Class-Class规则的方法。我们收到的反馈是执行过程冗长、难以理解。我很高兴地宣布我们的约束管理器团队开发了一个选项，可以看到二维数组的规则分配。打开Spacing Domain – Net Class-Class工作表，即可看到新的“Cset assignment matrix”。 - F4 u* u' L+ u4 R# W: N
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4 Y [ I2 l) d J0 Z2 p 欢迎您的评论！ 您可以通过PCB_marketing_China@cadence.com联系我们，非常感谢您的关注以及宝贵意见。$ q! {7 Q% ]' \
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发表于 2018-1-29 11:06
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