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2017年12月29日QA检查报告节选

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发表于 2017-12-30 08:53 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.电源太细
# T8 z0 e4 l3 Q
1 [% j. V* _# n* \' H/ f' @[url=https://www.eda365.com/thread-160823-1-1.html][/url]
; H7 n* t1 A2 `% @, A, b
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发表于 2018-1-2 20:11 | 只看该作者
EDA365QA 发表于 2017-12-30 08:53
% X) _$ j5 t% U4 m2 ~8 o4.多个千兆网口线建议有参考面
: Y5 _; x( p# p3 S9 x2 z& a% |
为啥有参考面,以哪个地作为参考面?机壳地?打静电时有没有影响,有什么理论依据,我设计的一块也是多个千兆网口,一开始是机壳地做参考,最后还是没做参考,EMC测试没问题。
2 ?- n0 n: R  E) u. e3 C3 H

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发表于 2018-1-2 09:29 | 只看该作者
EDA365QA 发表于 2017-12-30 08:53) I  \9 B: h4 K. C. s8 m$ C. F
4.多个千兆网口线建议有参考面
0 V$ D) C0 T2 f0 k. w
请教一下,这个参考面是需要用外壳地来做吗?
; u* F: U5 T6 a% ]7 n

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发表于 2018-1-2 13:30 | 只看该作者
EDA365QA 发表于 2017-12-30 08:537 A4 k9 n: H, x' o8 H
4.多个千兆网口线建议有参考面

" t8 @2 \: l* r. }: V" u; V建议用中心抽头上的地,不能用机壳地!3 _3 n" F$ b0 ~5 `8 w

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 楼主| 发表于 2017-12-30 08:53 | 只看该作者
2.电感加强' {0 l) z3 B6 n8 n
$ P7 _' w7 s0 o

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 楼主| 发表于 2017-12-30 08:53 | 只看该作者
3.电阻两端需等长3 Z: O; K7 I( \7 N' W! J) F
$ p& ^5 g# F( _+ B( O6 Q

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 楼主| 发表于 2017-12-30 08:53 | 只看该作者
4.多个千兆网口线建议有参考面- Y; i% T- Z7 U

& m. }" s1 p, T0 e2 U! `, P

点评

为啥有参考面,以哪个地作为参考面?机壳地?打静电时有没有影响,有什么理论依据,我设计的一块也是多个千兆网口,一开始是机壳地做参考,最后还是没做参考,EMC测试没问题。  详情 回复 发表于 2018-1-2 20:11
建议用中心抽头上的地,不能用机壳地!  详情 回复 发表于 2018-1-2 13:30
请教一下,这个参考面是需要用外壳地来做吗?  详情 回复 发表于 2018-1-2 09:29

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 楼主| 发表于 2017-12-30 08:54 | 只看该作者
5.USB参考平面要完整9 H. i( r% X/ I5 O; b3 W: V

) D7 x! V3 d% l) r

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 楼主| 发表于 2017-12-30 08:54 | 只看该作者
6.电源有瓶颈+ i% c& E- q" L1 x
6 z, E) d: M3 C1 i: d3 P. p

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 楼主| 发表于 2017-12-30 08:54 | 只看该作者
7.有部分模拟线没加粗9 X3 ?0 a) y  n- u( \% n9 x. b3 R, z
" _9 x/ ]' s8 F2 `& b7 u

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 楼主| 发表于 2017-12-30 08:54 | 只看该作者
8.电源加粗3 E6 S4 u4 b( c
, W' v/ D1 C% z7 ^

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 楼主| 发表于 2017-12-30 08:54 | 只看该作者
9.CAN走差分) w) ^9 M5 Z4 w% W( j0 y# G+ c( r: n
0 W! y! _1 n+ c+ S! J: M5 Q

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 楼主| 发表于 2017-12-30 08:55 | 只看该作者
10.电源输入在电容前打VIA,输出电源加粗.
; y6 Z( E. D6 A( a6 q1 {  m; q0 H
5 l7 {4 U) w6 ]' d) U

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