ratsnest_schedule鼠线问题

faeng · 发表于 2017-12-20 17:29

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在PCB设计的时候，开始面板时，我喜欢把电源网络设置成ratsnest_schedule的power_and_ground
但是把地设置这个属性后，将地网络打孔的时候，文件变得好卡好卡? 有没有遇到过这种问题的兄弟？一起分享分享
我把opengl关了后还是一样的卡

yangjinxing521 · 发表于 2017-12-20 21:32

设置成无飞线就好了吧。。。

kevin890505 · 发表于 2017-12-21 15:39

把原理图里面这个属性删了，然后PCB里面也删了，重新添加即可，属于兼容性BUG

kinglangji · 发表于 2017-12-21 17:02

kevin890505 发表于 2017-12-21 15:39
8 V% @3 N6 _" |1 ~' i把原理图里面这个属性删了，然后PCB里面也删了，重新添加即可，属于兼容性BUG

这么有空。。

faeng · 发表于 2017-12-22 22:41

kevin890505 发表于 2017-12-21 15:39# u0 Y9 M" ?7 x6 O6 C6 S5 w
把原理图里面这个属性删了，然后PCB里面也删了，重新添加即可，属于兼容性BUG

版本问题么？
我的好像16.6是打的100的补丁
哪个补丁不会出现这种情况呢？

kevin890505 · 发表于 2017-12-23 11:30

faeng 发表于 2017-12-22 22:41$ t, g* J# D7 y" z% g; F: h$ z4 A8 M
版本问题么？$ E7 w8 H, C4 [6 {1 d1 G# @
我的好像16.6是打的100的补丁
$ v+ ~+ p% U2 p* v 哪个补丁不会出现这种情况呢？

和这个貌似没关系，我记得之前碰到是因为是基于15还是什么版本修改的原理图，导进来就有这问题，但是把原理图里面清除属性，把PCB的power删了再手动添加就没事了。

faeng · 发表于 2017-12-29 09:07

kevin890505 发表于 2017-12-23 11:30
* q- z# D/ b- ]+ }' s和这个貌似没关系，我记得之前碰到是因为是基于15还是什么版本修改的原理图，导进来就有这问题，但是把原 ...

谢谢解答

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