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各位,请问如图所示DRC错误是什么意思

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发表于 2017-9-28 09:48 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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请问如图所示DRC错误是什么意思?  B1 M& N) {" _' Q& F7 X- |

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发表于 2017-9-28 10:58 | 只看该作者
器件位置有干涉

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发表于 2017-9-28 09:48 | 只看该作者
器件间距问题,place bound 相交了。
# A2 i7 K/ `5 M! L' \6 ^

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发表于 2017-9-28 12:34 | 只看该作者
恩,同上

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发表于 2017-9-28 12:37 | 只看该作者
把所有的DRC打开可以看的到是什么问题, 楼上讲的对。
9 V0 b9 N2 e3 C: D
: Z/ O/ w- H8 z' H" {! ~

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发表于 2017-9-29 07:56 | 只看该作者
元件太近了   bound相交了

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发表于 2017-9-29 15:06 | 只看该作者
PCB封装中,一般会要求在器件的 place bound 层画一个器件大小轮廓,这个轮廓一般代表器件安装需要空间大小,而楼主这错误表示的是有两个或者几个器件的轮廓重合了,软件认为,这些器件无法能够有效的安装,提示了个RDC* M0 q: O; j0 ^- V: c/ [$ {5 F) ]
其实这个place bound 还能够用来做一些布局方面的设计,假设有一个10w相同器件的PCB需要布局,而又要求这些器件等间距排布,这时候利用 place bound 属性就能够很好且快速的完成这个事情

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发表于 2017-9-30 10:48 | 只看该作者
器件干涉,检查是不是库做大了,或者有兼容设计,否则要移动下器件了

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发表于 2017-10-9 17:38 | 只看该作者
一般这种都不用理会

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这个问题可不能不理会,有可能会导致焊接时物料重叠冲突,把placebound层打开,一个个DRC查看,一般placebound做的要比事物大一点,要是实际物料在焊接时不会重叠,那么可以修改下placebound这个shape的大小,让DRC  详情 回复 发表于 2017-10-10 09:05

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发表于 2017-10-10 09:05 | 只看该作者
Pang8343569 发表于 2017-10-9 17:38
& H. e! @+ ?5 V& p( m; P. m: R  D一般这种都不用理会
6 u9 s4 D8 U1 ~# F8 L9 f
这个问题可不能不理会,有可能会导致焊接时物料重叠冲突,把placebound层打开,一个个DRC查看,一般placebound做的要比实物大一点,要是实际物料在焊接时不会重叠,那么可以修改下placebound这个shape的大小,让DRC消失。- G7 D# n8 r% I: C* m

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同意  发表于 2017-10-16 11:12

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发表于 2017-10-10 17:25 | 只看该作者
要一个一个去看.不能忽略.

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发表于 2017-10-24 16:28 | 只看该作者
有时候元件交涉并不影响结果。看你是需要不需要。不管如何,PCB verify design后 应该不能有任何错误。

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发表于 2017-10-27 17:50 | 只看该作者
一般有丝印的 会将丝印做的跟实体一样大小或略大一点,
+ V* o* e6 [( w建库时 Bound层有时又会建的更大一点。
4 G/ `5 E" _4 L1 _$ J$ w导致package报错,如果板子空间比较紧张的情况下,可以根据实际器件的大小及使用情况进行摆放。
6 i: E( `+ t% v  Q& e3 r! GDRC就可以wave掉了

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发表于 2017-12-28 15:51 | 只看该作者
元件太近了
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