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EDA365电子工程师网»技术社区 › 电子技术社区 › PCB生产问题咨询 › 封装引起的短路
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封装引起的短路

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dzyhym@126.com

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发表于 2016-11-12 17:03 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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在https://www.eda365.com/thread-115866-1-1.html中提到allegro会输出一些dummy net，一直以来不清楚其原因。' t/ U$ r& n5 W# r7 v% I! c
前些天又有类似文件，潜下心来认真琢磨，终于明白原来是封装的一些隐藏管脚会导致这个问题。（网表中也有这些管脚）
0 X8 i; W# J' ~8 B希望大家在作封装时尽量将没有用的管脚删除，避免后面人员找不到短路问题原因。) h9 ~2 E- {$ w- H1 n% p

: H6 B$ |9 G" N0 e4 o8 W封装中有管脚名（网表中也有）1 f4 ?5 y% K9 l# Y
但下面在实际文件中没有管脚
, S" c1 s2 U) o  n# `! f$ {
- B; n! l* W& f6 o' c. l2 @

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02.jpg (57.98 KB, 下载次数: 0)

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许汉洲

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发表于 2016-11-17 21:06 | 只看该作者
这应该是转软件做的~

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发表于 2016-11-23 22:32 | 只看该作者
这就不规范了1 j! p* C* x$ [  [8 H3 ]0 a( |+ v
只有实物元件有的，pcb封装必定要做

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cjz351421568

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发表于 2017-6-15 22:02 | 只看该作者
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dzyhym@126.com
再仔细看看  详情 回复 发表于 2017-6-19 21:59

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dzyhym@126.com

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 楼主| 发表于 2017-6-19 21:59 | 只看该作者
cjz351421568 发表于 2017-6-15 22:023 D4 r" j3 l$ ]8 i% M( L
没看懂

$ r' t% Y# n0 y0 k! y; G- c0 y再仔细看看% H7 c+ p3 ~. u/ Y

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