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HDL显示成功导入到PCB,网络却没有变

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发表于 2017-11-9 14:41 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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原理图改了,PCB里却没有变,为什么啊?求大神
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发表于 2017-11-13 09:52 | 只看该作者
你HDL画原理图后package有没有成功?如果package没有问题,那么你可以把之前的一些shape或是cline给clp出来,然后把shape或cline删掉再导板子,应该就可以了。

点评

那如果是改版怎么办。。  详情 回复 发表于 2017-11-15 10:01

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 楼主| 发表于 2017-11-15 10:01 | 只看该作者
RickGao 发表于 2017-11-13 09:52
* s& \# S: ^- c% B; b8 s你HDL画原理图后package有没有成功?如果package没有问题,那么你可以把之前的一些shape或是cline给clp出来 ...
# Y4 G: O2 h% {& N' H
那如果是改版怎么办。。& }, v% K( y+ A& A3 ^% ~/ ^+ W4 T
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发表于 2017-11-28 12:42 | 只看该作者
问题太笼统,可能原因多!!!

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发表于 2018-3-14 12:00 | 只看该作者
到网表的时候,选项没勾对。
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