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typec-c 信号检测?看不懂里面的mos,太复杂了

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发表于 2018-6-29 14:07 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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typec-c 信号检测?看不懂里面的mos,太复杂了?) x, I2 n' v6 I! F& o) h
& l( h# M/ S# q% D
pdf是该款芯片介绍,在 第7页 是整个电路图,我截图了一些mos电路,看的云里雾里的,悲剧中$ \" J0 F4 S' K$ W; E/ C0 |( Y& T
高位高人能看懂这个电路,给详细分析一下哦?
: c2 T( m* l3 a" G) U% u$ M- U" c我推测应该是type-c 接口的可以充放电电路吧?不懂啊,这么多mos,具体可以分析一下吗?
- q6 s3 U0 k; p5 S/ K# U- g0 N/ u7 O2 Y

/ N3 y8 I3 p4 A" b# N# d" g
8 H0 d+ n6 U+ Y+ Q6 q+ `

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LDR6023 Spec EN V2.0-电路图.pdf

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 楼主| 发表于 2018-6-29 14:10 | 只看该作者
本帖最后由 soswelcome 于 2018-6-29 14:29 编辑
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坐等高手

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 楼主| 发表于 2018-6-29 14:11 | 只看该作者
USB3.1被称之为USB Type-C,从富士康公布的渲染图中可以看出Type-C采用了更小的全新设计,由于是对称设计我们在使用时不需要区分正反,和苹果Lightning接口很相似。
( }$ p) C% m2 f) G    另外USB3.1 Micro-B也发生了变化,变得更宽更薄,不过依然可以兼容现有的microUSB数据线。性能方面USB 3.1也将传输带宽从USB 3.0 5Gbps翻番到了10Gbps,同时还把供电电流从1.5A大幅增加到了3-5A,不但性能更快,充电也会快得多。: E! a0 v/ C" m: D4 m7 _+ @1 R' M
; L& t' `6 \0 f  @2 F4 ~
8 Y, K2 x# ~( J4 l3 U0 ^
但是遇到具体电路,就无法分析出来了,希望高手能一点点的把它分析出来

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发表于 2018-6-30 11:13 | 只看该作者
第一幅图应该是VBUS输出的控制电路,当VBUS_IN 有电时候,可以通过控制VBUS_EN 来给两个C口的VBUS供电,同时,如果VBUS没电,也就是type c spec中的dead battery的状态的时候,可以通过C0或者C1的type c 口可以通过Q1和D2给芯片供电,Q1和D2的作用应该是防止两个C口同时出现VBUS而对冲。VBUS会通过一个buck输出5V给到USB3.0的口。
' S3 X/ ]+ T3 W2 k. ]  p第二幅图应该是对应两个C口的VBUS上电的检测,任一个VBUS上电,对应的被上拉的信号都会被拉低。,,从而MCU就知道是哪个C口的VBUS已经ready6 e7 q3 @% S# Q  M$ E9 S1 r
第三幅图应该是两个C口的CC引脚的状态配置和检测,其中C0应该是DRP类型的端口,因为CC上既有作为sink用到的5.1k下拉,又有作为source用的180ua.330ua的上拉,同时USB_C0_CC1/2也是对CC电平状态的检测,MOS管的主要是DRP状态切换,但是C1看起来应该只能作为sink,因为它只有下拉电阻,至于为什么是7.5k,不是5.1k这个不是很清楚。

点评

在第一张图中,Q1和D2的作用应该是防止两个C口同时出现VBUS而对冲。VBUS会通过一个buck输出5V给到USB3.0的口。 感觉是否只需要D2就可以防止两个VBUS同时导通啦,也就是说Q1可以去掉?不知道要Q1的作用是什么?  详情 回复 发表于 2018-7-2 10:09
非常感谢,大概了明白了一点点 又有作为source用的180ua.330ua的上拉,这个是什么意思?电路图中没理由找到啊  详情 回复 发表于 2018-7-2 09:38

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发表于 2018-6-30 11:15 | 只看该作者
本帖最后由 kobeismygod 于 2018-6-30 14:54 编辑 % [: P: m* w8 f

: A& Q1 M  |  W1 [' e

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 楼主| 发表于 2018-7-2 09:38 | 只看该作者
kobeismygod 发表于 2018-6-30 11:13- `% v* K; a2 b' a6 B
第一幅图应该是VBUS输出的控制电路,当VBUS_IN 有电时候,可以通过控制VBUS_EN 来给两个C口的VBUS供电,同 ...

0 l  w3 P4 V  e' p; x  J! ?, [非常感谢,大概了明白了一点点
% o+ |& B( |* e( i) S: ]: q6 Q' }$ ]; D! E  Z3 `: v, Y$ j0 r
又有作为source用的180ua.330ua的上拉,这个是什么意思?电路图中没理由找到啊2 \6 L! |  d$ B+ U. ~* A

点评

在完整的原理图里面180ua 对应的是1.5A充电,330ua对应的是3A充电  详情 回复 发表于 2018-7-2 13:38

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 楼主| 发表于 2018-7-2 10:09 | 只看该作者
kobeismygod 发表于 2018-6-30 11:13! v2 s6 ?' I& F: L2 {' C3 c7 M
第一幅图应该是VBUS输出的控制电路,当VBUS_IN 有电时候,可以通过控制VBUS_EN 来给两个C口的VBUS供电,同 ...

( g3 ?5 J, l$ h0 D% a$ V* ~2 b在第一张图中,Q1和D2的作用应该是防止两个C口同时出现VBUS而对冲。VBUS会通过一个buck输出5V给到USB3.0的口。: ]9 i) L3 n5 ]" w7 R

& S' X4 F* }- e- K, v- U1 z% L  V( H/ B感觉是否只需要D2就可以防止两个VBUS同时导通啦,也就是说Q1可以去掉?不知道要Q1的作用是什么?+ F  G7 Q" u2 P* g

点评

我理解Q1的作用是给VBUS提供一个低阻抗通路,因为C0 口的电流最大可能达到3A或者以上。  详情 回复 发表于 2018-7-2 14:36

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soswelcome 发表于 2018-7-2 09:38' W0 {% F. D7 ~  S
非常感谢,大概了明白了一点点+ U: z1 R2 g$ q
- {, }3 r  m' r2 p2 a
又有作为source用的180ua.330ua的上拉,这个是什么意思?电路图中没理 ...

" O/ ~/ D* C. q6 r% ?- F3 T在完整的原理图里面180ua 对应的是1.5A充电,330ua对应的是3A充电
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; {6 E" L( X; B/ i9 E5 S( W

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发表于 2018-7-2 14:36 | 只看该作者
soswelcome 发表于 2018-7-2 10:09( p% ?( ?7 ]4 D$ ~$ x
在第一张图中,Q1和D2的作用应该是防止两个C口同时出现VBUS而对冲。VBUS会通过一个buck输出5V给到USB3.0 ...

& k  D. r# U  e% |- ?我理解Q1的作用是给VBUS提供一个低阻抗通路,因为C0 口的电流最大可能达到3A或者以上。
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