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PCB检查布线99.87%,找不到未布线net

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发表于 2018-4-19 16:04 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x

( s6 G* i$ c0 b! h( f1 R # s) q! i2 S; _! S, e
问题描述:1 u2 D2 y6 K$ {# x
1.PCB检查如上图。软件提示未连接net均是死铜皮块。但是死铜皮左边是X=9669,Y=5339,坐标位置均为我PCB不能坐标的外部。所以不清楚为何会这样报错。PCB外确定无任何铜皮块。& s8 {1 i) o6 }, Q6 p, W7 {$ {
2.完成99.87%,找不到未布线net。* E) P9 Y6 D: B8 W! J4 ^8 z

% m2 }; h) a9 f3 S. T
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 楼主| 发表于 2018-4-20 16:07 | 只看该作者
yihafewu 发表于 2018-4-20 14:15
. m5 c9 I  a9 q! k0 _找一个报错的封装,连同周围的元件和走线,复制,新建一个PCB,进行特殊粘贴-保持网络名,再drc看看。
5 p+ {' N. m+ V# {3 U9 Z* u如 ...

% ?& @0 s8 N. ^) O9 d! [" D问题解决了。新建PCB,复制过来检测100%、但是复制过来的时候内电层分割的铜皮net有丢失,自己全部重新定义了一下。但是S1S2S3层铜皮我发现更新不起作用。如图:4 x/ c- ?3 w3 w1 i
,外部铜皮轮廓会显示,手动不能更新。大神是否知道是何缘故。如果这个能解决,我就在新的PCB里再检查检查投板。
' J4 Y& K- y! P! m) y: X3 i+ E0 ]

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 楼主| 发表于 2018-4-20 11:51 | 只看该作者
yihafewu 发表于 2018-4-20 09:17+ P3 ], n" \4 T- m+ e
新建一个PCB,层叠设置一样,把图拷过去试试。

2 L- n, u5 H) L- z% U" x1.检查规则:5 G: |( H# _" M  H6 z2 O$ c

7 b; L# E3 G: Q9 j2.检查结果:* f3 p- Y, ]8 g0 ?' d  ]) i1 {4 u1 f
  @: P3 r4 ]1 }7 k" }+ W) b  c
可以看出没有出现net未连。但是检测板子信息如下:% h( R: V9 q6 z* i4 \9 {1 N9 g
3.还有两个net未连接。把板子所有东西都隐藏也没发现有飞线。
8 O# ^" ]0 C( Q, ~9 e, e* j% b. m) n# X* H 4 T5 N* y- c' m" W% M( J4 A$ u* J& u" ^
, _, H) v8 |# |1 C

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 楼主| 发表于 2018-4-20 16:28 | 只看该作者
yihafewu 发表于 2018-4-20 16:16
! ]* F0 q) m3 t0 x, _& r% K3 v2 Z+ ps1s2s3是正片层?这些铜皮是手工放置的polygon吧?% y( q# h; A) q. y" Q
如果是,切换到相应层,那么双击它,在这个属性对话框 ...
2 @  d9 O# ]) f: J! {
正片手动放的铜皮,在16里边怎么样也不行。我把所有设置都回复默认设置也不行。我有用AD9打开发现可以跟新了。所以现在问题彻底解决了。

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发表于 2018-4-20 08:09 | 只看该作者
本帖最后由 yihafewu 于 2018-4-20 08:49 编辑
0 C% }- V/ B6 E& b8 s5 a3 x9 G% |" S% l3 i1 B3 N) r
切换到G1层,看看GND网络是否存在孤岛(没有与其他GND铜皮连在一起的孤立铜皮)。' q0 M3 I" Z) }
还有P层的DSP的几个电源网络。+ n, e+ n. j1 a; O7 d+ |
- r+ B  _1 [- j7 v# F

点评

G1层,很明显没有孤岛。 [attachimg]137396[/attachimg] P层:很明显也没有。 [attachimg]137397[/attachimg]  详情 回复 发表于 2018-4-20 08:49

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 楼主| 发表于 2018-4-20 08:49 | 只看该作者
yihafewu 发表于 2018-4-20 08:094 q) W$ {! c, L: z  w, u
切换到G1层,看看GND网络是否存在孤岛(没有与其他GND铜皮连在一起的孤立铜皮)。! c+ \. O2 z( R5 Y' L" e
还有P层的DSP的几个电源 ...
& P" \! H: A2 Z) e# }+ H

& d0 l+ T3 Q# t$ v% G8 m  NG1层,很明显没有孤岛。5 q5 w9 J4 m7 b6 r1 s) L7 Q1 g

4 Z7 _4 E/ g4 ?1 M, MP层:很明显也没有。% }3 I# W9 ^( U

5 ?( |) u) [# a3 p. H' i, F. J+ {5 I' z' M" P6 {6 c

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发表于 2018-4-20 08:56 | 只看该作者
兄得,你再仔细看看,有孤岛啊,你的两个图里都有啊。
4 H  r0 _' c$ V8 O" b我的电脑是加密过的,没法截图给你。/ j+ s+ f: W* g5 _  m: Z! V$ \
比如电源那里,你高亮的部分,中上,靠左,五个过孔处。你在孔比较密集的地方找。

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[attachimg]137398[/attachimg] 没有啊。都是十多年老司机了。这个真把我难住了。  详情 回复 发表于 2018-4-20 09:04

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发表于 2018-4-20 09:00 | 只看该作者
preferences->system->navigation,在highlight methods的那个标尺,移到靠近close处,你双击messages的时候会定位到目标处

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 楼主| 发表于 2018-4-20 09:04 | 只看该作者
yihafewu 发表于 2018-4-20 08:56
( t2 Q' N$ W* [( |5 Q6 v3 {兄得,你再仔细看看,有孤岛啊,你的两个图里都有啊。0 y% [8 q3 u7 b, i8 i- H
我的电脑是加密过的,没法截图给你。7 ~7 k. W. @; {
比如电源那里 ...
! q" w5 y* i3 @6 m2 b6 D

0 R9 P: j  q# C1 r4 ?没有啊。都是十多年老司机了。这个真把我难住了。3 K0 i- U2 i- E, L

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发表于 2018-4-20 09:11 | 只看该作者
看看能看到不
* K8 G8 o; |% C; F% D/ l# J

IMG_2483.PNG (1.15 MB, 下载次数: 2)

IMG_2483.PNG

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发表于 2018-4-20 09:17 | 只看该作者
新建一个PCB,层叠设置一样,把图拷过去试试。

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1.检查规则: [attachimg]137416[/attachimg] 2.检查结果: [attachimg]137417[/attachimg] 可以看出没有出现net未连。但是检测板子信息如下: 3.还有两个net未连接。把板子所有东西都隐藏也没发现有飞线。 [a  详情 回复 发表于 2018-4-20 11:51
解决了。我板子上连接器的焊盘有点大。我在P跟G1,G2层焊盘边缘放了一个圆做隔离,软件检测到园内是一篇孤铜。其实不影响电气特性。因为PCB生产过程中焊盘的铜壁厚就把内电层的孤岛覆盖了。  详情 回复 发表于 2018-4-20 11:25

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发表于 2018-4-20 11:00 | 只看该作者
一般打孔不规范的,或者建库不规范的,用负片就要注意

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 楼主| 发表于 2018-4-20 11:25 | 只看该作者
yihafewu 发表于 2018-4-20 09:179 m% h& b6 ?/ [
新建一个PCB,层叠设置一样,把图拷过去试试。
' D+ C& n( U) x6 [! a
解决了。我板子上连接器的焊盘有点大。我在P跟G1,G2层焊盘边缘放了一个圆做隔离,软件检测到园内是一篇孤铜。其实不影响电气特性。因为PCB生产过程中焊盘的铜壁厚就把内电层的孤岛覆盖了。
0 _8 j3 v7 c1 D! ?/ [) f4 i- Y

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发表于 2018-4-20 13:09 | 只看该作者
你把Clearance的检查关掉再DRC看看,你的错误总数已经达到5000了,这个值应该是你设置的最大错误数吧。

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[attachimg]137421[/attachimg] 无net的pin我挨个全看了。没有问题。但是布线还是不是100%  详情 回复 发表于 2018-4-20 14:00

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yihafewu 发表于 2018-4-20 13:09
; K  m1 x- j% H4 M, d, g你把Clearance的检查关掉再DRC看看,你的错误总数已经达到5000了,这个值应该是你设置的最大错误数吧。
! h% g3 a3 y$ A) S; L: J1 H7 }3 a- h6 E

* @; n; A2 }  g1 n% i4 H  k无net的pin我挨个全看了。没有问题。但是布线还是不是100%
, W1 I+ G3 E/ P! T1 t4 g: N1 I

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发表于 2018-4-20 14:15 | 只看该作者
找一个报错的封装,连同周围的元件和走线,复制,新建一个PCB,进行特殊粘贴-保持网络名,再drc看看。" k8 N/ @5 I7 u; B$ q
如果你的PCB不涉及保密的话,可以上传上来看看。

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问题解决了。新建PCB,复制过来检测100%、但是复制过来的时候内电层分割的铜皮net有丢失,自己全部重新定义了一下。但是S1S2S3层铜皮我发现更新不起作用。如图: [attachimg]137430[/attachimg],外部铜皮轮廓会显  详情 回复 发表于 2018-4-20 16:07
看私信消息。  详情 回复 发表于 2018-4-20 14:26

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 楼主| 发表于 2018-4-20 14:26 | 只看该作者
yihafewu 发表于 2018-4-20 14:15
; u/ q" p; `5 i0 [; t9 ^6 h找一个报错的封装,连同周围的元件和走线,复制,新建一个PCB,进行特殊粘贴-保持网络名,再drc看看。0 g0 z, h9 |$ `* y
如 ...

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