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[HyperLynx] 关于pin和die上的波形问题。

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发表于 2016-9-6 12:03 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 color_ 于 2016-9-6 12:03 编辑 - Q5 ~/ q2 u, J* F' ~7 }. t
+ t$ g7 T% m: H4 L6 P8 C+ W+ c
在输出一个ddr2 800 的波形时,pin上和die上波形相差很大,pin上波形出线非单调(有回沟),而die上的波形则没有,
6 V, \# c& }/ J1 E6 q修改走线对回沟没明显改善。
5 _! v% q/ t  ?
6 \1 M+ }- T/ ?6 @" R1 M单根数据线波形。$ @* N' k- s4 Q+ @  |7 w8 s

* x) g1 E* {3 v- L) I6 |9 \, Spin上的波形
' v" c& _  |$ Y7 S" A! k 7 l4 l4 v& R6 `7 V/ T9 `) j% {9 T
2 _; O9 l# M& J# X2 n$ ~! ~% R
& i2 k* j, P  p: B: I- W
die上的波形
( [; M2 j) U2 Y2 L' t4 e" F! {
2 E+ {& V8 ~5 _1 {
- I4 F& H: R. q3 x( G. n想了解一下,是否一般以die上的波形还是已pin上的波形来判定信号是否合格。: _, {( j5 k! H6 G4 q1 ]9 }( I
3 e, \; N2 U: [( m
然后就上升(下降)沿上产生回沟是因为封装的原因吗?/ O6 H' y. a- y$ \7 H
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发表于 2016-10-13 12:17 | 只看该作者
我觉得是要看die上的波形, 因为最终的信号是在die上面进入内部电路。也有人说只要pin上面的波形符合标准就可以,pin的die芯片公司设计保证可行的,我不是很同意。

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发表于 2016-10-14 18:20 | 只看该作者
PIN仿真用在要求不高的场合,要求高的话,需要在模型中加上一句语言,DIE的仿真就会很准了,因为在要求不高情况下,PIN和DIE的仿真相差不大的

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发表于 2016-10-14 18:23 | 只看该作者
在模型中加一句语言Timing Location die就可以解决了,也可以在在帮助文件中找到,

点评

能否具体指明一下在那份文档中吗?help文档太多,找起来有点吃力。。  详情 回复 发表于 2016-10-17 16:42
了解了,感谢大神指导。  详情 回复 发表于 2016-10-17 11:15

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 楼主| 发表于 2016-10-17 11:15 | 只看该作者
ytmgadw 发表于 2016-10-14 18:23
5 i( _- G' _/ d+ k) g# z4 V: V在模型中加一句语言Timing Location die就可以解决了,也可以在在帮助文件中找到,
- c, u0 j: B! J" H
了解了,感谢大神指导。) ^1 n( o! z  c+ ^1 N( \7 d1 B) F$ l

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 楼主| 发表于 2016-10-17 16:42 | 只看该作者
ytmgadw 发表于 2016-10-14 18:23
& C; t+ e1 M- Y+ U1 u1 Z% o在模型中加一句语言Timing Location die就可以解决了,也可以在在帮助文件中找到,
+ Y8 P; U  Z& ?5 j
能否具体指明一下在那份文档中吗?help文档太多,找起来有点吃力。。- M% O6 u) e) C7 O% `# l

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发表于 2017-2-20 14:38 | 只看该作者
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