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[仿真讨论] 求PCIe3.0 插损和回损的参考标准

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发表于 2014-11-20 16:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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如题:求PCIe3.0 插损和回损的参考标准
" V2 J2 X) v6 }0 m1 t6 f- A0 _哪位大师可以给参考资料# G1 P' k1 {* x) }# I4 \) ~8 f2 ]; ~
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发表于 2015-11-7 22:10 | 只看该作者
Quantum_ 发表于 2015-11-3 15:029 `' }) Y! i+ s( b- P! w/ Y
我公司的某PCBA 发到 I....公司做测试。
6 E2 d/ f5 i5 C他们反馈的信息是.
2 Q! X% i: m1 L+ X* r$ s) p3 x--Find a problem during return loss tes ...

( ~+ T" B: H4 D5 _+ R, G7 t( w1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?
7 ?& @" w" |# S% \0 b: lReturn Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。
4 X% k# h5 x7 \& _) i; A" K
* y" h! A- N- B2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!# Z$ {+ I7 Y2 g+ ?
RL测量时通道的频域测量,而眼图是时域测量。不是说RL不过眼图就一定会很差,RL不过只能说明通道存在不连续问题,导致信号在某些频点上的反射比较大,能量不能很好的从发送端传输到接收端,而眼图是时域测量结果,这个结果不仅仅包括频域上的RL,也跟频域的IL和编码以及热噪声等很多因素相关,并且眼图还可有均衡等方式。所以说不是简单的认为眼图完美,其他的结果就一定都是Pass的。
7 o; J$ R+ G7 d+ H

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发表于 2014-11-22 09:36 | 只看该作者
先参考协议
- J$ i/ |' M; w" B  Y, I再根据走线长度来定,关键还是接收端可接受level
新年伊始,稳中求胜

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 楼主| 发表于 2014-11-26 15:08 | 只看该作者
cousins 发表于 2014-11-22 09:36# I- @: `& h! ^7 P$ ?
先参考协议
5 \5 s# L8 m4 w* h$ a再根据走线长度来定,关键还是接收端可接受level

* d6 q# i; H) P虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到无源通道的标准,无源通道不是能够说明整个链路的损耗情况吗,如果满足一定的标准,而且我的发送和接收都满足PCIe标准是不是就ok的,PCIe2.0有PCIe3.0没有,

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发表于 2014-12-5 23:03 | 只看该作者
shirley_zong 发表于 2014-11-26 15:08: S, r: v8 R& k$ G
虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到 ...
9 S8 w! Z2 y$ T! ]% {% g
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕量就会比较大,如果EQ能力比较弱,那么对PCB的设计就要求比较高。在Intel的PDG里面,从Host到Receiver的Total length,你可以根据这个去设计你的物理通道。PCIE的specification只有Gen1有对IL进行规定,Gen2和Gen3都不对IL做规定,所以各位在设计物理通道时需要根据EQ能力做相应的调整。6 [0 }) C; r& B

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那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?  详情 回复 发表于 2015-10-31 23:36

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 楼主| 发表于 2014-12-18 10:15 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:03* N1 E; A; t* F: e( j: V
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...

+ E: H' E8 w% Y9 |6 Q; x我知道PDG中呀长度,但是我们的设计师OOG的,所以添加retimer,想带retimer仿真,现在还无从下手,所以想看看频域上面的情况9 O4 \" F- V3 P, l

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发表于 2015-10-31 23:36 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:03
! J4 _- {; h) O因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...

: w, }+ ]+ v6 R那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?  r/ c; ?; M: N( b2 g) H3 L

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建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。  详情 回复 发表于 2015-11-1 10:32

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964008794 发表于 2015-10-31 23:36
4 @. @, o" `% {3 K' ~那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?

6 q8 h# I4 ~. @( O( Y0 M建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。

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我公司的某PCBA 发到 I....公司做测试。 他们反馈的信息是. --Find a problem during return loss test on T..3 connectors. 此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的  详情 回复 发表于 2015-11-3 15:02

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发表于 2015-11-3 15:02 | 只看该作者
Coziness_yang 发表于 2015-11-1 10:32, Z- ]" p7 k$ F( a, I
建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有 ...

% v0 ~/ P$ C9 _, N我公司的某PCBA 发到 I....公司做测试。
3 b& @5 p* G# m8 s9 }( E* h  c% W他们反馈的信息是.
5 @$ p. l3 s5 ?--Find a problem during return loss test on T..3 connectors.
& R! k) Q' @3 R  k# n$ `" j此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的。 6 s5 i" M3 `2 T0 ~7 T
我的问题是:/ M( J( {! V7 d9 o; P% z" X
1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?* l. I% f5 \, j( @4 z! v
2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!! L. \9 l* _" e% i
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1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备? Return Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。 2. 有点迷糊了, 难道眼图的模版里,  详情 回复 发表于 2015-11-7 22:10
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