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差分线等长重要还是等距重要

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发表于 2015-10-26 09:53 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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如题,差分线等长重要还是等距重要啊,要打过孔的差分线怎么走
2 q! j( b$ x9 }$ B& S
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发表于 2015-10-26 10:56 | 只看该作者
具体情况具体分析,同场合的需求是不一样的,根本没有什么必然关系,一切要按指标来。 以太网是串行接口,最大传输距离100m,5类线的每对间的最大延迟误差指标是50ns@100m,PCB走线长度那一点点差异相对于线缆简直就是毛毛雨,设计上更注重阻抗匹配,降低损耗,等间距重要。 DDR内存就不一样了,因为是并行接口,数据位要求和时钟严格同步,而传输距离并不长,所以等长比差分更重要。过孔越少越好。

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打完过孔肯定会发生不匹配,其实要求没有那么严格,想要严格做阻抗控制你可以做仿真  详情 回复 发表于 2015-10-26 21:55
打了过孔感觉就不等距了,怎么办  详情 回复 发表于 2015-10-26 13:08

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发表于 2015-10-26 11:00 | 只看该作者
这个问题其实本身就是个错误,一定是经验主义,等长是为了等相位,而不至于差分作用体现不出来;等距是为了阻抗不变化,保持阻抗的一致性;via的话就对称打就好啦。

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谢谢 ,打过孔距离就变化了 阻抗就不匹配了啊  详情 回复 发表于 2015-10-26 13:10

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 楼主| 发表于 2015-10-26 13:08 | 只看该作者
12345liyunyun 发表于 2015-10-26 10:56, D* L/ d& G1 [" x
具体情况具体分析,同场合的需求是不一样的,根本没有什么必然关系,一切要按指标来。 以太网是串行接口, ...
% J/ ?' i' W9 x0 |/ O6 x
打了过孔感觉就不等距了,怎么办
% L  t& I' T1 c- j+ P' }

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 楼主| 发表于 2015-10-26 13:10 | 只看该作者
菩提老树 发表于 2015-10-26 11:00
9 s4 d' M/ j1 T# h8 v1 a* C- w6 F& P8 B这个问题其实本身就是个错误,一定是经验主义,等长是为了等相位,而不至于差分作用体现不出来;等距是为了 ...

$ @& W% }  A* Q6 ]: \. l谢谢 ,打过孔距离就变化了 阻抗就不匹配了啊9 ^  @+ g. J. ]# X$ \

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这个是必然的,所以说via需要做阻抗处理。  详情 回复 发表于 2015-10-26 14:29

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fanchenydj 发表于 2015-10-26 13:10! \" O# `1 }, H# G
谢谢 ,打过孔距离就变化了 阻抗就不匹配了啊

7 l( q& e1 |. b这个是必然的,所以说via需要做阻抗处理。

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via 要怎么做阻抗处理啊  详情 回复 发表于 2015-10-26 16:58

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 楼主| 发表于 2015-10-26 16:58 | 只看该作者
菩提老树 发表于 2015-10-26 14:29
. h' h# F5 H  P# j这个是必然的,所以说via需要做阻抗处理。
4 X' t: J. W- J# ^) U& O- p
via 要怎么做阻抗处理啊9 u) E* n% ^$ q2 D- s

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这个需要你做一些via的仿真或者是测试才能确定。比如用多大drill,多大的pad,多大的anti-pad等等  详情 回复 发表于 2015-10-26 17:03

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发表于 2015-10-26 17:03 | 只看该作者
fanchenydj 发表于 2015-10-26 16:58+ i6 Y9 L+ s/ v' B. u0 K
via 要怎么做阻抗处理啊

4 X& L) O7 L3 F/ r/ o3 Y  a这个需要你做一些via的仿真或者是测试才能确定。比如用多大drill,多大的pad,多大的anti-pad等等

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发表于 2015-10-26 21:55 | 只看该作者
12345liyunyun 发表于 2015-10-26 10:567 U/ B) L+ b* m( J$ Y" s
具体情况具体分析,同场合的需求是不一样的,根本没有什么必然关系,一切要按指标来。 以太网是串行接口, ...
1 A  B6 H. ^# G" }
打完过孔肯定会发生不匹配,其实要求没有那么严格,想要严格做阻抗控制你可以做仿真" Q$ G! `7 O* p2 J% X. B# g

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谢谢  详情 回复 发表于 2015-10-27 08:35

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 楼主| 发表于 2015-10-27 08:35 | 只看该作者
12345liyunyun 发表于 2015-10-26 21:55' z8 h# @, K3 @( O2 d0 K, t
打完过孔肯定会发生不匹配,其实要求没有那么严格,想要严格做阻抗控制你可以做仿真

+ p9 d# L: v' s# X谢谢
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