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Net wire has multiple net name

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发表于 2014-7-19 21:10 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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在使用AD10的时候出现以下编译错误
7 p- i5 w; V# P' g7 L3 dNet wire has multiple net name(Net label SRAM_A0. Sheet Entry U_SRAM_Interface SRAM_A0(passive))
4 ^3 S; w# N: U6 t' J, g# G6 rWire SRAM_A0
+ ?  d* E5 E# x5 ^: U' uNet label SRAM_A07 f# |  Y/ i0 {! n: d( _% W# ?6 K
Sheet Entry U_SRAM-Interface SRAM_A0(passive)
6 \9 e2 _3 l' U+ ?. R& G7 M% ]3 i, O" A6 w8 b& R
sheet symbol的图纸
+ H$ x: h0 D4 `* z. X
% T# F* W- z+ l: v4 N0 ]6 E
: ?0 X3 H2 E3 S3 o总的sheet的图纸, ?; r% u, d, T8 r

: @1 U' L+ v% F/ G- {- w$ G" O8 @, K8 F5 z: h
为什么我所有的net name都是sram_a0,他还是说我在一根线上有多个net name。而且仅仅是warm,导入到PCB还是sram_a0, 不影响PCB layout
  I# d/ i/ X: O' _* m- ^  d很纠结,因为一编译message满是这种错误,也不知该如何解决。很烦
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 楼主| 发表于 2014-7-19 21:37 | 只看该作者
仅当我将project->project option中的Net identifier scope更改为
4 x1 L+ k& S6 N# V7 iGlobal (net label and port global)
& V8 n+ A( C6 I: _3 k# ]6 y7 A编译错误会没有,但是这非我所愿,很纠结
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