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Allegro 中怎么利用Analyze->Probe 出 inductance, capacitance report

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发表于 2014-3-14 15:46 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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如题, Allegro 中怎么利用Analyze->Probe 出 inductance, capacitance report?
7 Q$ e# X+ Q0 j& ~6 a; S, o为什么有些net 出不出来呢?  |9 J6 @& r+ ~; H6 z' c6 V
是不是要为每个Pin 定义好drive 和 receive 的类型?# v" {" S, v+ t7 S, g
求教高手,不知道有没有这方面的资料。

2014-03-14 15 41 15.png (18.11 KB, 下载次数: 0)

图一

图一

2014-03-14 15 43 30.png (36.26 KB, 下载次数: 0)

2014-03-14 15 43 30.png

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发表于 2014-3-26 17:38 | 只看该作者
你需要将你的NET的pin type设置正确。假如:你的pin1是输出就设置为:out ,pin2为输入就设置为:IN。
8 w0 d. z, v6 D! K( u1 m" B0 E& jother设置为:unspce。
# I( \' \6 }9 t0 n9 j7 Z还有就是你的buff模型要赋正确。
7 Y0 v8 M& d. ?% {* [你可以在logic--pin type里面去查看你的pin type和赋pin type

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 楼主| 发表于 2014-6-17 16:55 | 只看该作者
xiao_layout 发表于 2014-3-26 17:38
) \2 n1 ^/ h$ x4 n9 C# M, P你需要将你的NET的pin type设置正确。假如:你的pin1是输出就设置为:out ,pin2为输入就设置为:IN。9 D! b0 X+ L, q# E6 p* F% R
oth ...
2 X  n$ Q7 R1 _" W4 {
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