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FPGA JTAG调试正常,烧写后功能失败

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发表于 2013-9-13 17:50 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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现象:$ \& O) X( ]1 A
1.在JTAG调试模式,FPGA配置正常,通过SignalTap查看逻辑功能正常(输出端口)。
# F+ E1 S) A. {. B' T0 b2.配置芯片(EPCS4)可成功烧写,配置模式AS模式。* F7 t9 T, {4 M3 a. H& \
3.烧写后重启单板,FPGA功能无输出。
+ q7 l# l5 F$ F* ^6 r3 ^: u$ i6 K' y4 v  f1 H
解决:
' ]& b! q) J0 r3 l1.FPGA引脚补焊后,烧写后FPGA功能正常。: W4 s5 c) h' A$ P( f

. R3 ^8 d1 f, ]2 |7 t; Y7 l+ W不知道那些引脚会导致上述所描述的现象???: E8 i' _6 i' |2 P! H8 |
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发表于 2013-9-15 06:41 | 只看该作者
msel0-1-2,dclk,asdo等都有可能

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 楼主| 发表于 2013-9-15 21:41 | 只看该作者
guowei680 发表于 2013-9-15 06:41
1 `7 a7 }/ `8 r, u4 U% a, Imsel0-1-2,dclk,asdo等都有可能
1 R+ F' ^8 p' d7 B" j! j
这些引脚应该会 影响烧写吧!

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发表于 2013-9-16 08:19 | 只看该作者
你的AS口,其实可以拿掉的。可以用JTAG转烧的,文件类型转下jic那个的,JTAG间接配置
硬件工程师[原理图+PCB],电驱动方面,无刷控制器,电动工具,太阳能无刷泵,锂电保护板,仅限Altium。

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 楼主| 发表于 2013-9-16 12:39 | 只看该作者
zgq800712 发表于 2013-9-16 08:192 z! v. p2 ^/ I0 H1 e
你的AS口,其实可以拿掉的。可以用JTAG转烧的,文件类型转下jic那个的,JTAG间接配置
( S4 T6 U/ v+ N- R
配置文件用的就是.jic文件。
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