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[仿真讨论] 小发现:阻抗随频率增加不一定会减小

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发表于 2013-10-8 17:43 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 qingdalj 于 2013-10-8 17:46 编辑
2 p4 Q; s% v" {, d% }5 O2 K3 d
1 j, M7 k( ]0 b8 g, H8 `$ B       许多人都在讲随着频率的升高,传输线的特征阻抗会减小,我也一直这么认为。之前虽然有些疑问,但苦于无法验证自己的想法。用过polar的人应该都见过与下面类似的结果,相信很多人也是基于此得出的结论吧。- H( W9 _* f& g, L

' E1 ^( e3 Q# p       随着频率的升高,传输线电感会减小,而对于大多数PCB材料在频率升高时它的介电常数也会减小,从而导致传输线的有效电容也会减小。电感和电容都发生了变化,这使的我们不好判断阻抗的变化趋势了。
  M# C& M, W/ F" }" F    这里选取一种PCB材料的PP,它的参数如下图:
3 P5 t) _2 H0 F, u: ~% s 9 D! j; L# f! u
       首先根据上述参数调整叠构,使得差分对阻抗约为90欧姆,如下图:
: A2 x, P$ r& ~2 { ) \/ \5 k/ j- e5 T
       然后,将介质材料的介电常数按上面数据设置为分段形式:
3 ?& T& c2 D1 D ; z) O6 K5 A- |: e0 B
       然后点击calculate,得到如下结果:! h# S; x! H1 s$ [/ G5 [

& _  C) U0 V" c# X3 c1 v; _       这里给出不设置分段介电常数情况下的结果方便大家对比:% V$ u3 ~& x" j+ G+ ?& `  `9 a
( F. H  |' Z8 N7 L/ R
% z. s0 j. r" b: t0 X2 A7 ?
       现象描述:(1)介电常数分段情况下,在1GHz以内阻抗随频率增加而减小;1GHz以上阻抗随频率增加而增加(变化幅度较小),最终趋向稳定。' Y1 \- \  |8 X" ?$ @- K
              (2)介电常数固定的情况下,传输线阻抗随频率增加而减小,最终趋向稳定。3 p, ]1 C/ D* N: D

& l$ v: k* _. I9 v0 i2 H' L    原因分析:对传输线阻抗产生影响的因素为电感和电容,电感减小导致阻抗减小(假设电容不变),电容减小导致阻抗增加(假设电感不变)(1)介电常数分段情况下,1GHz以内介电常数没有变化,仅电感对阻抗产生了影响;1GHz以上电感和电容都减小,共同影响了传输线阻抗。(2)介电常数固定的情况下,阻抗只受电感变化影响,电感持续减小导致阻抗持续减小。
$ C( r" S' q4 W
. }# A! B8 _8 a5 e7 t    结论:频率升高,传输线的阻抗不一定会减小,可能会增加,也可能在不断波动。这里是特例,当然不能认为频率升高阻抗就增加了。
9 r/ I$ l. f& f  }4 X3 d* g  }5 V, T1 @2 U  Y) z9 J* j
附:9 A* i: T5 J+ B) W% \
介电常数分段情况下,电容和电感的变化如下:0 A  `/ y/ M/ R3 o2 _  }/ O, b( k

# G. h9 G2 W' F/ b" R5 y" ]- i! A% a
介电常数固定情况下,电容和电感的变化如下:
3 q% J, M' g& c; I5 Y5 d 6 D* F/ b& V* n+ A  \8 X

. t4 L/ Q+ T1 l: v
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发表于 2013-10-9 14:42 | 只看该作者
谢谢楼主的分析与分享!!
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