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请问这是怎么回事？

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houliang

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发表于 2008-8-11 16:45 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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在allegro hdl 15.7环境中，我在点击tools--packager utilities--electrical rules check 后出现下列情况，是怎么回事？请大家给看看
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Copyright (C) 1994 Cadence Design Systems
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