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EDA365电子工程师网»技术社区 › 电子技术社区 › Cadence Sigrity仿真论坛 › cadence16.6的创建和16.3的不一样？
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cadence16.6的创建和16.3的不一样？

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mokedeng

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发表于 2014-6-4 11:03 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
在cadence16.3中创建总线执行菜单命令Logic---Indentify Buses可以直接创建总线，然后在约束管理器中可以直接看到定义的总线。9 b; J2 N: N$ [9 W6 u8 Z

# B6 u" D7 V; d/ ^: U! A  C2 P: ~' K& m4 q0 O  ^
但是在cadence16.6中，首先创建总线 如图所示
0 S! D1 J' ~9 R. _( P3 y! d' s* c1 V ' k3 K& W3 Z/ |( l

' A8 `6 |4 R9 s+ R+ d7 K: I( W" C6 o" _4 S4 j- Z
点击确定之后 是一个signal bus setup的对话框
; {/ {! a% B) r* x: u & Y  T& V3 L" h8 t
$ f8 k& _0 \' f' I4 p
2 a1 ~; a2 Z0 a) V9 E2 Z

" x% c) o* N/ ~在这个对话框里面应该怎么操作呢
  S) `, ?* J" W, W8 d; L" X3 ]# z3 y: E8 ~
使得在约束管理器中出现总线的设置$ Y0 u0 a" f( e& n3 [( r
# G* a2 B  h" `
! v+ P, s$ u! V# t; Z( b8 V8 j+ T
/ a/ D3 P7 n% \$ }4 J
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 楼主| 发表于 2014-6-5 23:08 | 只看该作者
都没有人说说么

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