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为什么allegro 同层的pin 连线有pl 错误 而在引脚上打via 后就没有了

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发表于 2012-6-18 23:05 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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这是什么原因呢

123.jpg (9.07 KB, 下载次数: 0)

没打via 有pl drc

没打via 有pl drc

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在pin上打了via 后就没有pl drc 了

在pin上打了via 后就没有pl drc 了
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发表于 2012-6-19 09:34 | 只看该作者
走线必须从pin的正中心出线

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 楼主| 发表于 2012-6-19 18:39 | 只看该作者
怎么从正中心出线呢 以前只要在脚上就能拉线了

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发表于 2012-6-27 13:35 | 只看该作者
楼主,你这个问题解决了吗,我现在也是这种情况,很烦人啊,以前只要从焊盘拉一下就可以的,求指导

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发表于 2012-6-27 15:04 | 只看该作者
拉线的时候把右方Find里的选项都勾选上。

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未命名.jpg

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发表于 2012-6-27 16:13 | 只看该作者
1.你要保证constraint manager里same net spacing 设置要正确,如图a中options栏位对应的值应为true;
( q) |0 E- j, b$ Y3 \& T2.菜单栏中Analyze->Analysis Modes->Same net spacing Mode->全打勾;
. E5 N! ?, a+ l" @7 v4 U! o4 w$ Z          Physical Modes->Pad-pad direct connect->on;
( Q/ k3 X8 q, p4 V$ ]$ |' x
4 v; g# O& @  S4 Z你可以参照试试~

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