DDR匹配电阻

suicide915 · 发表于 2013-1-6 15:53

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DDR数据线、地址线的匹配电阻

布局的时候应该靠近FPGA还是靠近DDR放置呢？

布局的时候有什么要求？

香雪海 · 发表于 2013-1-7 08:22

看芯片的数据手册，不同的型号也会有不同的要求！

willyeing · 发表于 2013-1-7 08:39

这些规则是仿真做出来的，学学仿真吧。

风刃 · 发表于 2013-1-7 09:25

对于高速的，都是仿真调试结果说了算。如果没条件仿真，按照经验，串阻一般靠近CPU放置。带ODT功能的IC，一般不需要串阻作阻抗匹配。

0aijiuaile · 发表于 2013-1-7 09:35

1.FPGA一般内部带DCI功能，不需要串阻；
2.如果是DDR，则上拉电阻一般还是需要的，如果是DDR2以后，则数据线则不需要进行上拉电阻匹配；
3.对于简易拓扑结构，<2的负载（DDR），可以不需要进行阻抗匹配，只要保证线长尽可能短则可。

sleepyingcat · 发表于 2013-1-7 10:06

空口无凭，需要仿真和实际的布局布线相结合，最好再参与回板后信号测试，与仿真相比较

0aijiuaile · 发表于 2013-1-7 11:09

sleepyingcat 发表于 2013-1-7 10:06 $ S! L% x3 a' w4 k1 h6 Z
空口无凭，需要仿真和实际的布局布线相结合，最好再参与回板后信号测试，与仿真相比较

仿真也并不能解决所有的问题，仿真只能给出方案上的评估，用一般二维仿真工具对于很多方面的影响都无法考虑，如：耦合后的串扰，SSN，走线的三维结构；且模型的不精确或不完整都会影响仿真的精度。因此对于仿真而言，一般公司所做的，所考虑的还不是太多。所以不要太迷信仿真。以上的建议也是我多年仿真所得，但只是参考建议，希望对大家有所帮助。

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