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DDR3仿真

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发表于 2015-1-5 10:27 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
大家好,关于DDR3仿真,有些不解之处,请大家指导!/ ~* w, ^0 V' ~: c; }# I, A7 I
1.DDR3时序余量怎么计算?
5 C8 p2 n* w# Y8 c/ `# Q2 c. A5 U+ L2.下图中tIS(base)是个基值,标准上说:实际建立时间需要加上Δt,这个计算出来的总的tIS是DDR3芯片对建立时间的需求?还是实际电路的tIS?- w1 H8 t; r. ^+ b7 G
4 K9 w% j0 `, C/ X, V

; o* k3 ]; [" y; x3 g3 ` 6 K  D4 l$ d- t+ ~' K) [- r$ l
3.tIS有两个参考,AC150和AC175,到底用哪个?& {1 T$ Q6 V9 l7 i+ g
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发表于 2015-1-6 08:42 | 只看该作者
本帖最后由 cousins 于 2015-1-6 09:24 编辑 6 }: s% k* g8 Q! h+ u
; |. {3 b! U5 p6 V0 L. F6 h
1.tvb+tskew  tva-tskew   相位右偏为正,左偏为负  tvb为valid before 即理想DQ有效跳变前于strobe跳变的时间,tva为valid after,即理想DQ有效跳变后于strobe跳变的时间。skew为单根DQ允许的相偏/ I, R# P$ |2 _! m$ `4 ^  H% ~- S/ l( m
2.参考第一条可以知道,datasheet里为requirement。实际测的为tvb+tskew tva-tskew
. {! |7 D- A, o3.AC175 AC150代表的是门限偏移,即AC threshold +/- 175mV或者150mV,与速率有对应关系,速率越高,AC threshold +/-越小。9 a% k3 R$ C5 q/ \

" e9 f5 y2 n8 z, H3 r6 J. K考虑到clk jitter及DQ skew的影响,slew rate取较大值为比较严格的做法,因为slew rate越大,最低要求的建立保持时间越长。
新年伊始,稳中求胜

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发表于 2015-1-27 18:18 | 只看该作者
DDR3的时序参数是基于标准负载测试的, M' L  \: h! j( s& ?  N
, J& B* `' {& R9 v$ b' ~5 g5 V
/ m3 {0 D; D  B% i! g
实际负载不可能标准 所以波形有差别,负载过重过轻 等都会造成影响. O# |4 y0 ?1 M' L1 Q1 U: e
飞行时间偏移,包括芯片内部的逻辑偏移,buffer偏移,和PCB上走线的偏移. o2 s2 Q% E" W( ~: _& ~3 g
实际时序计算时要以接标准负载和实际负载计算飞行时间偏移
9 A5 M5 e- ]# C$ uDDR3的规范规定计算时序都要考虑derating
. Z# M+ H5 N: t( [3 P# F9 W% V6 r$ m 2 i9 V5 s8 y* A: Y( t2 ?* g/ a

点评

谢谢,关于slew rate和建立保持时间的关系,我还是不太明白:为什么slew rate越大,需要的建立和保持都会变大?  详情 回复 发表于 2015-2-5 08:57

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 楼主| 发表于 2015-1-6 08:37 | 只看该作者
Coziness_yang 发表于 2015-1-5 22:16
4 q9 l) D9 {, |1 l0 C0 o3 T. f计算Slew Rate主要是要看信号的质量,有的信号在上升沿上存在非单调,但有些信号是单调的,所以对于slew ra ...

! B" i, D; P/ g; G您好,谢谢您给我解答,那么在计算时序裕量时,需要减去建立时间,那么是不是说这时候的建立时间需要用slew rate和AC175的基值一起来确定?
% _+ Y2 m- O  X3 S8 g0 h" y
/ F8 _5 O3 l" a7 d. |6 u) b0 k
# f) V  ~0 M0 r; v9 v2 U8 _9 g
- Z' j) B4 d+ j' E+ y, I  F

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发表于 2015-1-5 15:34 | 只看该作者
看本质,看信号的上升沿,上升沿快用严格的规范。上升沿慢用稍微宽泛点的。

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 楼主| 发表于 2015-1-5 15:47 | 只看该作者
shark4685 发表于 2015-1-5 15:348 j8 U  [) ]/ f8 Y- f) K  H
看本质,看信号的上升沿,上升沿快用严格的规范。上升沿慢用稍微宽泛点的。
; n4 z/ b& a! _
谢谢版主,Slew rate的大小和tIS有直接关系吗?如果像下图这样,我认为不影响
/ {6 I; T+ f! Q7 K# g图中红线和黑线,我认为tIS都一样2 J0 z- b+ a- q& Q+ J6 l2 t) j+ P
3 E! v* k! f) C

( ^4 X) ?* E1 G2 B$ M) N

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发表于 2015-1-5 16:44 | 只看该作者
slew rate越大,相当于信号上升沿约小,所以时序上余量相当于变大了,对应标准就严格。
, v( l6 U8 H+ _. G
0 I$ U4 D, J  ?6 [3 m$ l8 O
4 l* L6 M5 h. b8 X

点评

版主,还得麻烦您下,这个问题我还是没太想明白。 slew rate越大,相当于信号上升沿越小,这好理解 但是,时序上升余量变大,这怎么理解?余量大了不是更好么,怎么会要更严格的标准? 谢谢!!!  详情 回复 发表于 2015-2-5 09:31

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 楼主| 发表于 2015-1-5 17:27 | 只看该作者
shark4685 发表于 2015-1-5 16:446 S! H% I7 L( E; i+ N
slew rate越大,相当于信号上升沿约小,所以时序上余量相当于变大了,对应标准就严格。
* ]; u9 ^, D6 h0 X
在计算时序余量时,如何使用这个slew rate?$ f- M+ }, _1 q4 z: Z: b

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发表于 2015-1-5 22:16 | 只看该作者
计算Slew Rate主要是要看信号的质量,有的信号在上升沿上存在非单调,但有些信号是单调的,所以对于slew rate我们需要采用不同的计算方法。而对于时序裕量,我们需要看slew rate,因为slew rate的不一样,时间裕量的计算肯定也不一样。

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发表于 2015-1-5 22:18 | 只看该作者
1. 总的tIS是DDR3芯片对建立时间的需求?# c* U! c4 z$ v$ }) ?
   是的,在 DDR3 pin 上所量到的 Setup time,要大于这个值 (tIS total),多出来的就是你的余量。0 A. i: u9 H( K( m' c+ w& Z' ^
) m1 E4 N$ g# e; X
2. tIS有两个参考,AC150和AC175,到底用哪个?
& L! {2 m/ b  Y9 @    都可以,但是选用 AC150 的余量会多一点,原因有历史因素,非三言两语可喻。* d, r- m( E; a; D+ }

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发表于 2015-1-6 08:35 | 只看该作者
想听听历时原因

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 楼主| 发表于 2015-1-6 08:40 | 只看该作者
Head4psi 发表于 2015-1-5 22:18- I* P4 D0 d+ }  k
1. 总的tIS是DDR3芯片对建立时间的需求?1 H4 z9 H4 n# G
   是的,在 DDR3 pin 上所量到的 Setup time,要大于这个值 (tI ...
. |, a% i' P. G# J8 _
多谢您,那就是说要下面的数据算出DDR3对建立时间的实际需求,然后在实际的仿真波形上测量建立时间,和这个需求值比较,对吗?  Q* [* g( v$ Q" w" T! O$ o2 W
9 }- |7 T8 g1 X3 q$ h0 k# l# o

. v" F" F# s% U . n+ P% H, k4 g# g* n& O3 G$ L

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 楼主| 发表于 2015-1-6 09:06 | 只看该作者
cousins 发表于 2015-1-6 08:42
! `$ V8 f% B3 A1 H/ k( w) F5 E8 l1.tvb+tskew  tva-tskew   相位右偏为正,左偏为负  tvb为valid before 即理想DQ有效跳变前于strobe跳变的 ...

- r" d+ l" x! R8 K  F0 D2 i. r; u- v时序余量是否可以直接从波形读取?
- ]3 n' d8 j& [: N

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发表于 2015-1-6 09:17 | 只看该作者
snsArvin 发表于 2015-1-6 09:06
7 t6 Q8 T; t2 u: h# p+ g1 v时序余量是否可以直接从波形读取?

% s' @7 V3 z: A# L9 R2 _/ d* E' q4 m不能,要抓取cursor后再做计算
6 R9 C, N; s; b5 V3 S3 F4 R  N
/ y1 D3 S8 M- H& L
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 楼主| 发表于 2015-1-6 09:29 | 只看该作者
cousins 发表于 2015-1-6 09:17
- U9 v5 T7 k, o3 W( ], w8 }不能,要抓取cursor后再做计算
# O3 h! S$ O/ v. M" J
版主,您前面讲的余量计算:tvb+tskew ,tva-tskew,为什么没有减去建立时间?
1 P2 _, u9 F; j9 w

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发表于 2015-1-6 11:14 | 只看该作者
因为tvb+tskew就是实际的建立时间,减去datasheet中的requirement就是裕量  }0 z( C$ t7 w. u: |; |5 \2 |
tva-tskew是实际的保持时间,减去datasheet中的requirement就是裕量+ M' c+ c: c- l- U6 z# D2 F
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