信号上升沿太缓，对时序有什么影响？

964008794 · 发表于 2015-10-8 17:40

您需要登录才可以下载或查看，没有帐号？注册

x

如题，求高手解答

cousins · 发表于 2015-10-9 12:35

可能造成好几种组合的影响，看你是数据，还是参考时钟，上升沿变缓意味着电平门限延迟。
数据的话一般是建立时间减少，保持时间可能增加；
时钟的话一般是建立时间增加，保持时间可能减少；
两个都变缓，那么保持时间一般减少了；
太缓还会造成Vih，Vil时间不够，这也是间接的时序要求。

菩提老树 · 发表于 2015-10-9 12:26

就是系统时序紊乱，采样信号无法采样

964008794 · 发表于 2015-10-9 15:09

本帖最后由 964008794 于 2015-10-9 15:17 编辑

cousins 发表于 2015-10-9 12:359 s0 c4 _! f1 Y! ]( d3 h7 ?
可能造成好几种组合的影响，看你是数据，还是参考时钟，上升沿变缓意味着电平门限延迟。 W$ N5 G* n' Y) Z" o$ S) [7 c
数据的话一般是建 ...

很详细，多些大神的解答，我最近也在学习时序方面的知识，感觉这些基本概念的理解还是不够深刻。资料上很多都是从普通时序讲到源同步时序，对我来说，最有用的还是源同步时序，因为DDR就是源同步时序，大神最开始接触时序是怎么学习的？有什么好的方法可以把时序问题理解的更深刻吗？非常感谢

cousins · 发表于 2015-10-9 16:17

964008794 发表于 2015-10-9 15:09
* y9 F8 t; e! C4 s1 ?) S+ R# ?很详细，多些大神的解答，我最近也在学习时序方面的知识，感觉这些基本概念的理解还是不够深刻。资料上很 ...

ddr规格书中的ac timing，JEDEC规范中的ac timing

qingdalj · 发表于 2015-10-14 17:14

cousins版主回答的好详细，不知道上升沿变缓后，下降沿会怎么变？

		自动登录	找回密码
密码			注册

[仿真讨论] 信号上升沿太缓，对时序有什么影响？