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System SI进行DDR仿真的问题

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发表于 2015-8-19 16:54 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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      我在用system SI进行DDR仿真的时候,ibs模型已经S参数都已经加载后,在 check signal connectivity一步,点击后,报错。见附件。1 p5 T3 ^5 \8 O8 d6 v/ x8 V
      请教各位大神,是哪里出了问题?  另外,port11,port12,16  名称是如何定义的?我都不知道问题往哪里定位。$ c6 f& s5 g! B& ?# B4 y% i
       救命啊,搞了好几天了。快崩溃了。: o  X: }6 W& n

软件报错信息.png (78.41 KB, 下载次数: 0)

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发表于 2015-8-19 17:19 | 只看该作者
首先,仿真路径最好不要有中文,因为有些软件会出错;其次,你的port定义有问题,检查一下你的port

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谢谢大神,我搞了好几天,终于找到问题在哪里了。添加VRM端口的时候,跟VDD_1.5V设置成了同样的正反馈。由于提取的S参数,只看S11,波形是正常的。就忽略了。 非常感谢大神指点!  详情 回复 发表于 2015-8-24 20:13

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发表于 2015-8-20 08:20 | 只看该作者
解决方法很简单,11,12,16,17,18这5个port你一定是设置了一模一样的正馈和负馈。删掉4个或者按照自己的需要修改下正馈或负馈就可以了。0 E8 |; W; B9 l4 x4 c+ ?: \( ]

点评

谢谢大神,我搞了好几天,终于找到问题在哪里了。添加VRM端口的时候,跟VDD_1.5V设置成了同样的正反馈。由于提取的S参数,只看S11,波形是正常的。就忽略了。 非常感谢大神指点!  详情 回复 发表于 2015-8-24 20:13
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 楼主| 发表于 2015-8-24 20:13 | 只看该作者
qingdalj 发表于 2015-8-19 17:199 X: U: [/ b% }0 ]
首先,仿真路径最好不要有中文,因为有些软件会出错;其次,你的port定义有问题,检查一下你的port
' g; y+ V, m6 q5 t5 S5 o" I: r$ E
   谢谢大神,我搞了好几天,终于找到问题在哪里了。添加VRM端口的时候,跟VDD_1.5V设置成了同样的正反馈。由于提取的S参数,只看S11,波形是正常的。就忽略了。 非常感谢大神指点!

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 楼主| 发表于 2015-8-24 20:13 | 只看该作者
cousins 发表于 2015-8-20 08:20* ~" V4 D; I9 |; x  ^" N
解决方法很简单,11,12,16,17,18这5个port你一定是设置了一模一样的正馈和负馈。删掉4个或者按照自己的需要 ...
% M/ h& }: ]2 G5 n) r; A
     谢谢大神,我搞了好几天,终于找到问题在哪里了。添加VRM端口的时候,跟VDD_1.5V设置成了同样的正反馈。由于提取的S参数,只看S11,波形是正常的。就忽略了。 非常感谢大神指点!
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