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EDA365电子工程师网»技术社区 › 电子技术社区 › PADS论坛 › 有关PADS中，DRC时，元器件优先级问题
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有关PADS中，DRC时，元器件优先级问题

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发表于 2011-11-24 15:10 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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PCB中，默认规则中，设为6MIL。由于有个芯片引脚间间距比较密（小于6MIL），如果采用默认的设计规则，DRC时，会显示报错。因而采用规则优先级，在COMPONENT中，对此元器件单独设置，间距设为5MIL& c7 D0 d/ d9 @$ v3 X
      但再进行DRC时还会报错。不知道是什么原因？请各位说说个人的看法3 H' A* o4 Y: Z- v( \2 {) f9 m
      说明：此DRC虽然不影响最终的PCB生产，自己明白是由于引脚太密造成了，但这个问题不解决心里总是感觉不舒服
0 @9 E. w/ s+ G
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jimmy

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2#
发表于 2011-11-24 16:08 | 只看该作者
将默认的SMD与SMD的间距设为5
专业服务：(价格面议)
代写作业
拉等长
调丝印
喂猪
欺负同学
打老师

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