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ORCAD错误,望高手解决

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发表于 2011-4-14 10:49 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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我画了原理图,但是进行DRC检验的时候老是报错。我们老说中间需要一个什么插件,我不知道是什么。还望高手点拨

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 楼主| 发表于 2011-4-14 12:48 | 只看该作者
没有人会吗??在画PCB板的时候需要一个接插件,但是多个FIFO却不能共用。。老是会报错

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发表于 2011-4-14 13:37 | 只看该作者
本帖最后由 jacklee_47pn 于 2011-4-14 13:43 编辑
$ r; e( n' M: e
* o& x; K' Y' A* i) E( S- z! i應該說是你建立元件庫的 PIN 的屬性, 有依照Datasheet所說的去設定成輸出 , 然而所接連的另一端元件庫的PIN 屬性也是輸出, 所以會顯示錯誤. 如果你認為你的原理圖沒有錯, 就忽略不理會這個錯誤.
! T) q; f# G% e. T: U7 ]另外可以在 DRC 裡面 ERC matrix 裡面可以去設定忽略(不要W 和 E), 在這樣做之後, 如果有真正不該有的output pin 接到 output pin , 是不會被檢查出來.- v, |$ R3 x$ ?( ~

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 楼主| 发表于 2011-4-14 13:48 | 只看该作者
回复 jacklee_47pn 的帖子; Z6 D" g% n- W+ ^5 e
1 X0 [6 Y; [% U" {* ?
不是那个问题!是多个FIFO芯片共用总线,应为几个FIFO有片选信号,我就直接把他们的输出端连在一起了,但是却老是报错,应该不用三态缓冲门的啊!

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发表于 2011-4-14 13:55 | 只看该作者
"几个FIFO有片选信号,我就直接把他们的输出端连在一起了"  ==>  [片选信号]的 PIN TYPE 是甚麼?

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 楼主| 发表于 2011-4-14 14:29 | 只看该作者
回复 jacklee_47pn 的帖子
) P% v, k5 [& W: K1 {, d
" a5 J: b; I6 ?9 v5 V+ _; ]我使用时钟控制读写顺序的7 b$ Z6 d$ ^+ H

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发表于 2011-4-14 17:24 | 只看该作者
我大概知道你的原理圖的構想,  可是 ORCAD 軟件他是死的, 不會分時多工, 不知道你是用的時鐘去控制讀寫的順序, ORCAD 裡面的 DRC 只看這個 PIN 你的設定是甚麼? 如果原理圖上有二個PIN(或以上)都是設定成 OUTPUT type 它的檢查結果就會告訴你錯誤, 並不代表仿真上或是實際電路會出錯.# A; i( |: E4 j( e
7 k2 S0 |' l& Q: a0 s0 M
所以之前我一直強調再問你的原理圖上的器件的 PIN 設定是麼? 原因就是這樣.
0 N& C# |* \5 n& J2 }' z

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 楼主| 发表于 2011-4-14 19:39 | 只看该作者
回复 jacklee_47pn 的帖子" y0 ]# K; i: I/ L- d- ?6 H

5 R* Q& W: l' r9 J+ d; g6 u6 M: G  e那那些错误就不管他了吗???还是要怎么改

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发表于 2011-4-15 18:30 | 只看该作者
只要PIN TYPE 与 off-page type,port type一至就行拉.output-output,input---input这样对应就行了.
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