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ZBT SRAM布线问题

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发表于 2011-1-18 15:03 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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最近要做一块ZBT SRAM的板子。- A' o+ H1 Z3 Y3 e
时钟频率能达到250MHz,LVCMOS电平标准,2~4个芯片需要公用地址线和控制线。
9 L5 F  T, J$ e4 o' ?网上没有找到关于PCB布线的资料,不知道信号等长、端接以及驱动多个芯片应该怎样设计。
3 w* j# [7 C3 Y8 M请问哪位牛人做过或者能给点建议?4 f" E6 q, Q; K5 D  Q3 X& W
' B  K4 y4 T# J; I( Y
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