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做了一块modify的板子( Y1 L) I# n1 @, h
在PCB里面改了一下电阻电容的net，还改了一下封装，最后需要synchronize一下
- }# {- b& b/ G2 n4 l6 i+ HSCH是从99se过来的，有很多port
- A2 s) i2 B% N, I- h8 M8 R2 Icompiler project的时候，出现了很多duplicate的ERC( [( _" @2 q9 [) K
ECO里面也是惨不忍睹，几乎要将所有的net都删完
+ b! S# ~! N, I0 S8 D8 l9 z0 e0 t/ X网上查了下，觉得问题应该出在port上，更改所有port为net label, 所有一切都OK了2 N& m4 K' n# l5 F
个人认为应该是port，net label的scope导致的这个问题
3 E. i2 u3 I) k) x" ]) e5 }当project有port的时候，AD默认port是在整个project有效的，相当于全局变量，net label只在某个或某几个sch里面有效，相当于局部变量
' f7 O& M2 |0 K# P删除port以后，net label则在整个project都有效了
# C r& F9 E% S6 n; F F5 \$ i4 P个人觉得port,net label的作用范围是可以人工设置的吧，在哪里可以设置呢. i) P% D7 E7 ^% b& d
99se在导出网表的时候有相关的选项，可是AD里面找了半天没有找到，难道只能软件默认吗
& H. m8 s5 e4 ^. q, K, A( A% g7 F8 b还有AD里面一个单独的PCB怎么导入netlist) m s9 I$ K# s8 `( s; d
谢谢
. i! ]) h& H3 U, u1 b1 x
! B: l- A' t& w3 j x7 x1 l3 V2 P |
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发表于 2010-10-21 23:58
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