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板子画完了,如何检查遗漏未布线的线路?

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发表于 2013-10-15 11:17 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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我试了两种方法,结果不一样,请教Jimmy老师和各位大大。
% g$ _# ?: [" @4 ^- G& u第一个是tools-Verify Design-connectivity  发现有isolate的线路,并全部依此连上后,再次Verify,显示如下,我理解的是此刻connectivity已经完整了。1 y. ]. X( Z; Y/ }: b  G
. j" e2 |- G# G

+ G6 G) e: u- W6 c  ?  I; o$ Y( X; f- W% e
, |  X& f0 A- [- n6 O, o& Y6 V
但是使用File-Report-statistics生成的报告却如下,显示的是总共有多少Connection 但是部分连接到是多少 未连接的有多少。。。
1 q0 U6 m8 R! o3 d- o) a; r, t; h* ]& D! R8 h2 d1 b1 C' P

) V- W7 C0 q6 j( t
. W% q4 I5 b8 {1 K/ U0 c2 `# t1 G* w* P: }
Statistics Report和之前用Verify产生的报告就矛盾了,我到底该依哪一份报告呢?{:soso_e127:}
' `  J) q7 M+ F$ A铺铜以后,目测原文件的飞线是没有了。。。当然也只是目测,还是要以报告为准啊。。。谢谢大家了4 \$ V- _1 n" X
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发表于 2013-10-15 11:46 | 只看该作者
我都是信tools-Verify Design-connectivity ,至于File-Report-statistics不知道是否考虑了如A和B引脚在原理图中连接在一起然后再一点接地,结果你在PCB中对A和B引脚是分开就近打孔接地,这样A和B没有直接相连,不知道软件统计时是否觉认为你有一个未连接?个人认为而已,没什么依据的,不知道是否这样,也请指导真相的朋友解答一下。

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发表于 2013-10-15 11:58 | 只看该作者
我也是相信DRC检查的,应该没有问题。楼上说的可能是报告认为没有连上的原因之一,我想可能还包括你的线有没有连到圆心的问题。这点目测不太能看出来。

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 楼主| 发表于 2013-10-15 12:43 | 只看该作者
CUICHAOYUE 发表于 2013-10-15 11:46
, T3 J! G$ q! ]/ c4 [2 x我都是信tools-Verify Design-connectivity ,至于File-Report-statistics不知道是否考虑了如A和B引脚在原 ...

: t2 J6 a; k' Z; n0 d2 D说的有道理哈,受教了。感觉PADS还是有点bug的,例如我在Route的时候将VIA打到同Net的连线上的时候,飞线并没有消失(VIA的NET和两条连线是一样的)必须要把该VIA和同net的PAD再连接一次飞线才会消失。。。可能是我操作方法不对吧?
( s% k7 E$ `% Z! X- L. n) m+ ^第一次用PADS,还在摸索中,目前看来就用Verify的结果吧。谢谢了!

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 楼主| 发表于 2013-10-15 12:52 | 只看该作者
subrina 发表于 2013-10-15 11:58; d3 h1 b7 y& y4 N( V/ S
我也是相信DRC检查的,应该没有问题。楼上说的可能是报告认为没有连上的原因之一,我想可能还包括你的线有 ...

! Y1 i, k5 }9 W9 }3 ^% n0 z嗯就用Verify的结果了,谢谢你!

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发表于 2013-10-15 13:07 | 只看该作者
首先,您的板子是否有多层覆铜接地?这种结果有可能是因为一层上(往往是元件面)覆铜之后,由于走线和元件布局的原因,有很多块被隔断的孤立的铜被认为是未完全连接的,而实际上这些孤立铜层上都有过孔在另一个接地平面上连接上了,所以DRC不会报错,不知道是不是这种情况

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 楼主| 发表于 2013-10-15 13:28 | 只看该作者
cloudy19880824 发表于 2013-10-15 13:07: Y( Y) k0 j$ \7 [/ r/ L( e! Z4 ]1 g
首先,您的板子是否有多层覆铜接地?这种结果有可能是因为一层上(往往是元件面)覆铜之后,由于走线和元件 ...

$ q/ w* l9 D+ l+ U" L4 b有可能,有些地方确实没法走线进去了,只有通过覆铜+VIA的方式.Connectivity没问题的话 应该就还好。另外请问一下有没有遇到过Connectivity 检查没问题,但是依然有飞线的情况?

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发表于 2013-10-15 14:00 | 只看该作者
jxyggg 发表于 2013-10-15 13:28
9 q) `$ O- e  S7 A, h6 A9 p有可能,有些地方确实没法走线进去了,只有通过覆铜+VIA的方式.Connectivity没问题的话 应该就还好。另外 ...
6 _+ j& V6 G7 \8 p$ l
曾经有过一次忘了更改了哪个设置,所有GND的飞线就都出现了,不过只要重新做一次connectivity的检查,应该就不会还有飞线出现的

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 楼主| 发表于 2013-10-15 14:18 | 只看该作者
cloudy19880824 发表于 2013-10-15 14:00
% [2 ~6 @- z* S# h8 j曾经有过一次忘了更改了哪个设置,所有GND的飞线就都出现了,不过只要重新做一次connectivity的检查,应 ...
+ \0 i8 s0 _7 U- y, t( D9 U
好的!感谢!有了高手帮忙,心里也要稳当些了!

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发表于 2013-10-15 15:52 | 只看该作者
tools-Verify Design-connectivity  这个完全可以相信!
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 楼主| 发表于 2013-10-15 16:13 | 只看该作者
jimmy 发表于 2013-10-15 15:52+ t! p9 J2 H. ^7 F
tools-Verify Design-connectivity  这个完全可以相信!

' D) s+ g% Z# j7 b6 q$ B6 D: W好!THX!

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发表于 2013-11-10 19:28 | 只看该作者
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