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敢问各位大侠，小弟近日使用Capture CIS进行原理图设计，完成后输出网表，并想通过Allegro进行PCB设计。但
- g: u) t0 B6 `3 o* A. b& G% wAllegro输入网表后，出错，显示如下：0 ] b9 D$ ]# C- t5 A6 e
Problems with device 'MC74LCX125_0_14PIN, TSSOP_IC_MC'. JEDEC_TYPE property '14PIN, TSSOP' is illegal: + M" M3 w1 y3 Q
'Package name has invalid characters or is too long.'.Device 'MC74LCX125_0_14PIN, TSSOP_IC_MC' has
8 \3 V& w/ y! g, B, glibrary errors. Unable to transfer to Allegro.
4 A9 P' @: X2 G6 C; i所以有以下几个问题：. q- O. Q# A5 Z* Z
1) 如何解决以上问题，是CAPTURE CIS里定义的封装和 ALLEGRO所提供的封装不符吗？
e3 c, N$ B' ~1 w/ W2）Capture CIS生成的元件库，在Allegro导入网表后会自动将Capture CIS元件库里的元件转换成可以在Allegro里摆7 y. Z/ W$ t* p- S) C8 h6 z
放的元件吗？
$ R8 u& @! N: N1 y3 E# G3）Allegro里提供的“Part developer”工具也会生成原理图里元件封装，与Capture CIS生成的元件库有什么关系？
2 R# X$ y8 L2 ^/ ~$ t9 C+ P! S4）Allegro里提供的“Part developer”生成的库是否能用到Capture CIS的设计中？
" ^, e9 z9 ^7 \- Q5）Capture CIS里摆放库里的元件有两种方法：“Place Database Part”，快捷键“Z”与“Part。。。。”，快捷键! e! ~7 w! J1 @) [" ~2 G3 p% q
“P”有什么联系和区别呢：" [$ B3 [+ r: Z7 c* W! ]; x2 o
烦请大哥大姐帮我解决此问题，感激不尽。 |
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发表于 2008-4-17 16:11
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发表于 2008-4-17 17:13